[其他]數字相位表電路無效
| 申請號: | 86108211 | 申請日: | 1986-12-10 |
| 公開(公告)號: | CN86108211A | 公開(公告)日: | 1987-08-12 |
| 發明(設計)人: | 索恩克·米爾加德特 | 申請(專利權)人: | 德國ITT工業有限公司 |
| 主分類號: | G01R25/00 | 分類號: | G01R25/00 |
| 代理公司: | 中國國際貿易促進委員會專利代理部 | 代理人: | 趙越 |
| 地址: | 聯邦德國弗*** | 國省代碼: | 暫無信息 |
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| 摘要: | 用可集成的相位表電路測量第一時鐘信號的脈沖邊沿與第二時鐘信號的脈沖邊沿之間的相位差。第二時鐘信號通過一分頻電路加到由m個延遲單元組成的非鐘控延遲線上,也加到由m個寄存單元組成的第二寄存器上,而第一寄存器的m個單元都由第一鐘信號控制。兩寄存器的第k單元的輸出,由一列m個XOR門中的第k個XOR門進行比較,當這些輸出的電平不同時,第k門的輸出為邏輯1。多路加法器對各邏輯電平求和其A處的n位輸出就是相位值。精度與m相符,m最好取2n。 | ||
| 搜索關鍵詞: | 數字 相位 電路 | ||
【主權項】:
1、數字相位表電路用于測定,在第二時鐘信號CK2的兩個脈沖取樣間隔間,第一時鐘信號CK1的脈沖邊沿與第二時鐘信號CK2的脈沖邊沿之間的相位差,特征在于:一個分頻電路FF,一個其輸入由第二時鐘信號(CK2)提供,其輸出和由一列m個延遲單元(VC1…VCm)組成的延時線(V)的輸入相連接,并與第二寄存器(R2)的時鐘信號輸入端相連接。第二寄存器包括一列m個寄存單元(R21…R2m),每一單元都由分頻電路(FF)輸出端的時鐘信號控制。一個第一寄存器(R1),由一列m個寄存單元(R11…R1m)組成,每個寄存單元都由第一時鐘信號(CK1)控制,一列XOR門(G1…Gg),其中第K個門的第一輸入端(1)和第一寄存器(R1)中相應的第K單元(R1K)的輸出端相連接;第K門的第二輸入端(2)和第二寄存器(R2)中相應的第K單元(R2K)的輸出端相連接,第一寄存器R1和第二寄存器R2的第K寄存單元的輸入端,都和延遲線V中相應的第K延遲單元(VCK)的輸出端相連接,該電路有一受控制線(Lt)控制的多路加法器(Ma),產生n位輸出信號(B)該加法器有m個輸入端,分別與XOR門(G1…Gm)中之一的輸出端相連接,一個在控制線(Lt)與第一寄存器(R1)的第一單元(R11)的輸出端之間的連接。
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