[發(fā)明專(zhuān)利]一種基于雙通道DDR3的SAR數(shù)據(jù)存儲(chǔ)和訪問(wèn)方法及裝置有效
| 申請(qǐng)?zhí)枺?/td> | 202110129411.0 | 申請(qǐng)日: | 2021-01-29 |
| 公開(kāi)(公告)號(hào): | CN112947854B | 公開(kāi)(公告)日: | 2022-08-19 |
| 發(fā)明(設(shè)計(jì))人: | 王國(guó)慶;謝宜壯;陳禾;陳亮 | 申請(qǐng)(專(zhuān)利權(quán))人: | 北京理工大學(xué) |
| 主分類(lèi)號(hào): | G06F3/06 | 分類(lèi)號(hào): | G06F3/06 |
| 代理公司: | 北京億騰知識(shí)產(chǎn)權(quán)代理事務(wù)所(普通合伙) 11309 | 代理人: | 陳霽 |
| 地址: | 100081 *** | 國(guó)省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 基于 雙通道 ddr3 sar 數(shù)據(jù) 存儲(chǔ) 訪問(wèn) 方法 裝置 | ||
1.一種基于雙通道DDR3的SAR數(shù)據(jù)存儲(chǔ)和訪問(wèn)方法,其特征在于,包括:
S901,將SAR數(shù)據(jù)矩陣劃分為若干個(gè)大小相等的子矩陣;
S902,將各個(gè)子矩陣按照順序映射至第一DDR3中;其中,子矩陣的大小等于所述第一DDR3一行可以存儲(chǔ)的數(shù)據(jù)個(gè)數(shù);
S903,將各個(gè)子矩陣中的數(shù)據(jù)按照交叉映射的方式對(duì)應(yīng)存儲(chǔ)至所述第一DDR3中的各行;其中,所述第一DDR3中的各行存儲(chǔ)的數(shù)據(jù)為第一待處理數(shù)據(jù);
S904,在SAR算法流程的本次操作中,從所述第一DDR3中讀取第一閾值個(gè)數(shù)第一待處理數(shù)據(jù)并對(duì)其進(jìn)行與本次操作對(duì)應(yīng)的第一處理,得到第一閾值個(gè)數(shù)與本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù),在將所述第一閾值個(gè)數(shù)與本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù)寫(xiě)入第二DDR3中的同時(shí),從所述第一DDR3中讀取下一第一閾值個(gè)數(shù)所述第一待處理數(shù)據(jù),重復(fù)讀取與寫(xiě)入,直到所述第一DDR3中的所有第一待處理數(shù)據(jù)全部經(jīng)過(guò)所述與本次操作對(duì)應(yīng)的第一處理,并將得到的與本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù)全部寫(xiě)入第二DDR3中;
S905,在SAR算法流程的該次操作中,從所述第二DDR3中讀取第二閾值個(gè)數(shù)與本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù)并對(duì)其進(jìn)行與該次操作對(duì)應(yīng)的第二處理,得到第二閾值個(gè)數(shù)與該次操作對(duì)應(yīng)的第二處理相應(yīng)的第二數(shù)據(jù),在將所述第二閾值個(gè)數(shù)與該次操作對(duì)應(yīng)的第二處理相應(yīng)的第二數(shù)據(jù)寫(xiě)入第一DDR3中的同時(shí),從所述第二DDR3中讀取下一第二閾值個(gè)數(shù)與本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù),重復(fù)讀取與寫(xiě)入,直到所述第二DDR3中的所有與本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù)全部經(jīng)過(guò)所述與該次操作對(duì)應(yīng)的第二處理,并將得到的與該次操作對(duì)應(yīng)的第二處理相應(yīng)的第二數(shù)據(jù)全部寫(xiě)入第一DDR3中;
S906,交替重復(fù)S904和S905,直至SAR算法流程結(jié)束,得到與SAR算法流程結(jié)束時(shí)對(duì)應(yīng)的SAR圖像數(shù)據(jù),其中,所述SAR圖像數(shù)據(jù)包括SAR算法流程最后一次本次操作得到的與最后一次本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù),或SAR算法流程最后一次該次操作得到的與最后一次該次操作對(duì)應(yīng)的第二處理相應(yīng)的第二數(shù)據(jù),當(dāng)所述SAR圖像數(shù)據(jù)為SAR算法流程最后一次本次操作得到的與最后一次本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù)時(shí),將其寫(xiě)入所述第二DDR3中,或當(dāng)所述SAR圖像數(shù)據(jù)為SAR算法流程最后一次該次操作得到的與最后一次該次操作對(duì)應(yīng)的第二處理相應(yīng)的第二數(shù)據(jù)時(shí),將其寫(xiě)入所述第一DDR3中;
其中,所述第一DDR3和所述第二DDR3的數(shù)據(jù)位寬和容量與所述SAR數(shù)據(jù)矩陣的數(shù)據(jù)位寬和大小匹配;
其中,所述將各個(gè)子矩陣中的數(shù)據(jù)按照交叉映射的方式對(duì)應(yīng)存儲(chǔ)至所述第一DDR3中的各行,包括:
將各個(gè)子矩陣相鄰兩行的SAR數(shù)據(jù)交替映射存儲(chǔ)至所述第一DDR3中的一行。
2.根據(jù)權(quán)利要求1所述的方法,其特征在于,所述從所述第一DDR3中讀取第一閾值個(gè)數(shù)第一待處理數(shù)據(jù)并對(duì)其進(jìn)行與本次操作對(duì)應(yīng)的第一處理,包括:
采用突發(fā)傳輸模式對(duì)所述第一DDR3中第一閾值個(gè)數(shù)第一待處理數(shù)據(jù)進(jìn)行距離向數(shù)據(jù)訪問(wèn)或方位向數(shù)據(jù)訪問(wèn),得到第一距離向數(shù)據(jù)訪問(wèn)結(jié)果或第一方位向數(shù)據(jù)訪問(wèn)結(jié)果;
對(duì)所述第一距離向數(shù)據(jù)訪問(wèn)結(jié)果或所述第一方位向數(shù)據(jù)訪問(wèn)結(jié)果進(jìn)行與本次操作對(duì)應(yīng)的第一處理;
其中,每個(gè)第一距離向數(shù)據(jù)訪問(wèn)結(jié)果為第一待處理數(shù)據(jù)的兩條距離向的數(shù)據(jù),每個(gè)第一方位向數(shù)據(jù)訪問(wèn)結(jié)果為第一待處理數(shù)據(jù)的四條方位向的數(shù)據(jù)。
3.根據(jù)權(quán)利要求1所述的方法,其特征在于,所述從所述第二DDR3中讀取第二閾值個(gè)數(shù)與本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù)并對(duì)其進(jìn)行與該次操作對(duì)應(yīng)的第二處理,包括:
采用突發(fā)傳輸模式對(duì)所述第二DDR3中第二閾值個(gè)數(shù)與本次操作對(duì)應(yīng)的第一處理相應(yīng)的第一數(shù)據(jù)進(jìn)行距離向數(shù)據(jù)訪問(wèn)或方位向數(shù)據(jù)訪問(wèn),得到第二距離向數(shù)據(jù)訪問(wèn)結(jié)果或第二方位向數(shù)據(jù)訪問(wèn)結(jié)果;
對(duì)所述第二距離向數(shù)據(jù)訪問(wèn)結(jié)果或所述第二方位向數(shù)據(jù)訪問(wèn)結(jié)果進(jìn)行與該次操作對(duì)應(yīng)的第二處理;
其中,每個(gè)第二距離向數(shù)據(jù)訪問(wèn)結(jié)果為第一數(shù)據(jù)的兩條距離向的數(shù)據(jù),每個(gè)第二方位向數(shù)據(jù)訪問(wèn)結(jié)果為第一數(shù)據(jù)的四條方位向的數(shù)據(jù)。
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G06F 電數(shù)字?jǐn)?shù)據(jù)處理
G06F3-00 用于將所要處理的數(shù)據(jù)轉(zhuǎn)變成為計(jì)算機(jī)能夠處理的形式的輸入裝置;用于將數(shù)據(jù)從處理機(jī)傳送到輸出設(shè)備的輸出裝置,例如,接口裝置
G06F3-01 .用于用戶(hù)和計(jì)算機(jī)之間交互的輸入裝置或輸入和輸出組合裝置
G06F3-05 .在規(guī)定的時(shí)間間隔上,利用模擬量取樣的數(shù)字輸入
G06F3-06 .來(lái)自記錄載體的數(shù)字輸入,或者到記錄載體上去的數(shù)字輸出
G06F3-09 .到打字機(jī)上去的數(shù)字輸出
G06F3-12 .到打印裝置上去的數(shù)字輸出
- 支持DDR2和DDR3雙內(nèi)存模式的AMD平臺(tái)主板
- DDR2轉(zhuǎn)DDR3子卡
- 一種測(cè)試DDR3數(shù)據(jù)有效窗口的方法和裝置
- 一種可兼容DDR2和DDR3的OCD模塊
- 一種降低DDR3內(nèi)存寫(xiě)操作功耗的實(shí)現(xiàn)方法
- 一種基于國(guó)產(chǎn)FT1500A芯片的DDR3接口板級(jí)電源供電設(shè)計(jì)方法
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- 一種支持DDR3內(nèi)存的主板及計(jì)算機(jī)
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