[發明專利]控制裝置、程序以及控制方法在審
| 申請號: | 202080097305.2 | 申請日: | 2020-12-17 |
| 公開(公告)號: | CN115176208A | 公開(公告)日: | 2022-10-11 |
| 發明(設計)人: | 仲野征彥;三宅裕希;大倉嵩史;太田政則;若年哲司 | 申請(專利權)人: | 歐姆龍株式會社 |
| 主分類號: | G05B19/05 | 分類號: | G05B19/05 |
| 代理公司: | 北京三友知識產權代理有限公司 11127 | 代理人: | 章琴;馬建軍 |
| 地址: | 日本國京*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 控制 裝置 程序 以及 方法 | ||
1.一種控制裝置,其對控制對象進行控制,其中,該控制裝置包含:
處理器;
存儲部,其保存多個程序;以及
調度器,其對在預先確定的周期內,使所述處理器按照優先級執行的程序進行管理,
所述存儲部的所述多個程序包含:
第1程序,其是在所述周期中由所述處理器執行的執行優先級最高的程序,用于所述控制對象的實時控制處理;
第2程序,其是執行優先級比所述第1程序低的程序,用于與所述實時控制關聯的關聯處理;以及
系統服務的第3程序,其執行優先級比所述第2程序低,在所述周期中有處理器的空閑時間的情況下被執行,
所述調度器包含切換部,在所述周期內開始所述第2程序的執行、然后在所述第2程序中執行了預先確定的種類的命令代碼的情況下,所述切換部使所述處理器中斷所述第2程序的執行而開始執行所述第3程序。
2.根據權利要求1所述的控制裝置,其中,
所述實時控制處理包含以下處理:基于通過所述關聯處理生成的中間代碼,生成針對所述控制對象的指令值,
所述預先確定的種類的命令代碼包含如下這樣的命令代碼:該命令代碼在被執行時生成遍及多個周期的所述中間代碼。
3.根據權利要求1或2所述的控制裝置,其中,
所述預先確定的種類的命令代碼包含等待命令代碼,所述等待命令代碼使用等待條件和判斷是否滿足該等待條件的代碼進行描述。
4.根據權利要求1~3中的任意一項所述的控制裝置,其中,
所述第2程序包含以解釋器語言描述的程序。
5.根據權利要求1~4中的任意一項所述的控制裝置,其中,
所述系統服務包含按時間序列對記錄進行保存的、時間序列數據庫的處理,所述記錄包含與所述控制對象相關的數據。
6.根據權利要求5所述的控制裝置,其中,
所述控制裝置還具有:
數據生成部,其按照每個所述周期,生成用于構成應保存到所述時間序列數據庫的記錄的數據;以及
形成在易失性的主存儲裝置上的非阻塞隊列,其依次保存由所述數據生成部生成的數據,
所述系統服務包含以下處理:從所述非阻塞隊列讀出所述數據,并保存到所述時間序列數據庫。
7.根據權利要求6所述的控制裝置,其中,
所述控制裝置具有所述時間序列數據庫。
8.根據權利要求6或7所述的控制裝置,其中,
所述控制裝置還具有監視所述非阻塞隊列的內存余量的余量監視部,
所述切換部基于所述內存余量與閾值的比較結果,使所述處理器中斷執行中的所述第2程序的執行,開始所述第3程序的執行。
9.根據權利要求1~8中的任意一項所述的控制裝置,其中,
所述第1程序包含在所述第2程序的執行中斷的情況下被執行的、所述關聯處理的命令代碼。
10.一種程序,其由具有用于對控制對象進行控制的處理器的控制裝置執行,其中,該程序具有:
調度器程序,其對在預先確定的周期內,使所述處理器按照優先級執行的程序進行管理;
第1程序,其是在所述周期中由所述處理器執行的執行優先級最高的程序,用于所述控制對象的實時控制處理;
第2程序,其是執行優先級比所述第1程序低的程序,用于與所述實時控制關聯的關聯處理;以及
系統服務的第3程序,其執行優先級比所述第2程序低,在所述周期中有處理器的空閑時間的情況下被執行,
所述調度器程序包含切換程序,在所述周期內開始所述第2程序的執行、然后在所述第2程序中執行了預先確定的種類的命令代碼的情況下,所述切換程序使所述處理器中斷所述第2程序的執行而開始執行所述第3程序。
11.一種控制方法,控制具有用于對控制對象進行控制的處理器的控制裝置,其中,
所述控制裝置具有:
第1程序,其是在預先確定的周期中由所述處理器執行的執行優先級最高的程序,用于所述控制對象的實時控制處理;
第2程序,其是執行優先級比所述第1程序低的程序,用于與所述實時控制關聯的關聯處理;以及
系統服務的第3程序,其執行優先級比所述第2程序低,在所述周期中有處理器的空閑時間的情況下被執行,
所述控制方法具有對在所述周期內使所述處理器按照優先級執行的程序進行管理的步驟,
進行所述管理的步驟在所述周期內包含以下步驟:
判斷是否開始執行所述第2程序、然后在所述第2程序中執行預先確定的種類的命令代碼;以及
在基于所述判斷的情況下,使所述處理器中斷所述第2程序的執行而開始執行所述第3程序。
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