[發明專利]一種開關機方法、電路及電子設備有效
| 申請號： | 202011264610.4 | 申請日： | 2020-11-11 |
| 公開（公告）號： | CN112462910B | 公開（公告）日： | 2022-07-12 |
| 發明（設計）人： | 任東亮;謝長云;牟道祿 | 申請（專利權）人： | 煙臺艾睿光電科技有限公司 |
| 主分類號： | G06F1/26 | 分類號： | G06F1/26;G06F1/3234 |
| 代理公司： | 北京市萬慧達律師事務所 11111 | 代理人： | 陳怡 |
| 地址： | 264010 山東*** | 國省代碼： | 山東;37 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 開關機 方法 電路 電子設備 | ||
1.一種開關機方法，所述開關機方法基于開關機電路，其特征在于：所述電路包括按鍵、開機控制芯片、FPGA處理器、或門電路以及電源芯片；
其中，所述開機控制芯片以及所述FPGA處理器連接在所述按鍵與所述或門電路之間，所述或門電路的輸出端與所述電源芯片連接；
所述方法至少包括如下步驟：
當所述按鍵按下時，所述開機控制芯片根據所述按鍵輸出的信號輸出對應的第一預設信號；
當所述FPGA處理器處于開啟狀態時，所述FPGA處理器根據所述按鍵輸出的信號輸出對應的第二預設信號；
所述或門電路根據所述第一預設信號以及所述第二預設信號給所述電源芯片輸出開啟或關閉的信號。
2.根據權利要求1所述的開關機方法，其特征在于，所述開機控制芯片根據所述按鍵輸出的信號輸出對應的第一預設信號包括：
當所述開機控制芯片檢測到所述按鍵輸出下降沿且低電平持續第一時間后，所述開機控制芯片輸出高電平且持續第二時間后切換為低電平。
3.根據權利要求1或2所述的開關機方法，其特征在于，所述方法還包括：當所述FPGA處理器處于關閉狀態時，所述FPGA處理器在完成上電初始化后持續輸出高電平。
4.根據權利要求2所述的開關機方法，其特征在于，當所述FPGA處理器處于開啟狀態時，所述FPGA處理器根據所述按鍵輸出的信號輸出對應的第二預設信號包括：
當所述FPGA處理器檢測到所述按鍵輸出下降沿且低電平持續第三時間后，若所述FPGA處理器接收到關機信號，則所述FPGA處理器將輸出的高電平切換為低電平。
5.根據權利要求1或2所述的開關機方法，其特征在于，所述或門電路根據第一預設信號以及所述第二預設信號控制所述電源芯片開啟或關閉包括：
當所述第一預設信號以及所述第二預設信號至少有一個為高電平時，所述或門電路給所述電源芯片輸出開啟信號，當所述第一預設信號以及所述第二預設信號均為低電平時，所述或門電路給所述電源芯片輸出關閉信號。
6.一種開關機電路，其特征在于：所述電路包括按鍵、開機控制芯片、FPGA處理器、或門電路以及電源芯片；
其中，所述開機控制芯片以及所述FPGA處理器連接在所述按鍵與所述或門電路之間，所述或門電路的輸出端與所述電源芯片連接；
當所述按鍵按下時，所述開機控制芯片根據所述按鍵輸出的信號輸出對應的第一預設信號；
當所述FPGA處理器處于開啟狀態時，所述FPGA處理器根據所述按鍵輸出的信號輸出對應的第二預設信號；
所述或門電路根據所述第一預設信號以及所述第二預設信號給所述電源芯片輸出開啟或關閉的信號。
7.根據權利要求6所述的開關機電路，其特征在于，所述按鍵的一端與所述開機控制芯片以及所述FPGA處理器的POWER_KEY引腳連接。
8.根據權利要求6或7所述的開關機電路，其特征在于，所述或門電路包括兩個第一二極管，所述兩個第一二極管的正極分別與所述開機控制芯片以及所述FPGA處理器的使能輸出端連接，所述兩個第一二極管的負極并聯后與所述電源芯片的使能端連接。
9.根據權利要求7所述的開關機電路，其特征在于，所述電路還包括第二二極管，所述第二二極管的負極與所述按鍵連接，所述第二二極管的正極與所述FPGA處理器的POWER_KEY引腳連接。
10.一種電子設備，其特征在于，所述設備包括權利要求6至9中任一項所述的電路。
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