[發(fā)明專利]具有裸片以執(zhí)行刷新操作的設(shè)備在審
| 申請?zhí)枺?/td> | 202011079625.3 | 申請日: | 2016-05-17 |
| 公開(公告)號: | CN112185438A | 公開(公告)日: | 2021-01-05 |
| 發(fā)明(設(shè)計)人: | 紫藤泰平 | 申請(專利權(quán))人: | 美光科技公司 |
| 主分類號: | G11C7/22 | 分類號: | G11C7/22;G11C11/406;G11C11/4076;G11C11/4093;G11C11/408 |
| 代理公司: | 北京律盟知識產(chǎn)權(quán)代理有限責(zé)任公司 11287 | 代理人: | 王龍 |
| 地址: | 美國愛*** | 國省代碼: | 暫無信息 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 具有 執(zhí)行 刷新 操作 設(shè)備 | ||
本申請涉及具有裸片以執(zhí)行刷新操作的設(shè)備。一些實施例包含一種設(shè)備,其包括:接口芯片,其具有振蕩器以產(chǎn)生原始時鐘信號;第一存儲器芯片,其具有第一存儲器單元;及第二存儲器芯片,其具有第二存儲器單元。可響應(yīng)于基于所述原始時鐘信號的第一時鐘信號而刷新所述第一存儲器單元。可響應(yīng)于基于所述原始時鐘信號的第二時鐘信號而刷新所述第二存儲器單元。
本案是分案申請。該分案的母案是申請日為2016年05月17日、申請?zhí)枮?01680012281.X、發(fā)明名稱為“具有裸片以執(zhí)行刷新操作的設(shè)備”的發(fā)明專利申請案。
本申請案主張2015年5月18日申請的序列號為14/714,962的美國申請案的優(yōu)先權(quán)的權(quán)益,所述美國申請案的全部內(nèi)容以引用的方式并入本文中。
技術(shù)領(lǐng)域
本申請涉及半導(dǎo)體設(shè)備,特別是具有裸片以執(zhí)行刷新操作的設(shè)備。
背景技術(shù)
例如DRAM(動態(tài)隨機存取存儲器)的一些半導(dǎo)體裝置執(zhí)行刷新操作以恢復(fù)存儲器單元中的電荷以維持邏輯數(shù)據(jù)的經(jīng)儲存狀態(tài)。一般來說,在周期性基礎(chǔ)上或在命令基礎(chǔ)上針對DRAM的單個裸片執(zhí)行刷新操作。當(dāng)涉及多個裸片時,操作更復(fù)雜,使得電流消耗及穩(wěn)定性變得更難以控制。
發(fā)明內(nèi)容
根據(jù)本發(fā)明的第一方面,一種設(shè)備包含:接口芯片,其包含產(chǎn)生原始時鐘信號的振蕩器;第一存儲器芯片,其包含經(jīng)配置以響應(yīng)于原始時鐘信號而接收第一時鐘信號的第一端子、被供應(yīng)第一控制信號的第二端子、及當(dāng)?shù)谝豢刂菩盘栐谧饔弥袝r響應(yīng)于第一時鐘信號而經(jīng)受數(shù)據(jù)刷新操作的第一存儲器單元;及第二存儲器芯片,其包含經(jīng)配置以響應(yīng)于原始時鐘信號而接收第二時鐘信號的第三端子、被供應(yīng)第二控制信號的第四端子、及當(dāng)?shù)诙刂菩盘栐谧饔弥袝r響應(yīng)于第二時鐘信號而經(jīng)受數(shù)據(jù)刷新操作的第二存儲器單元。
根據(jù)本發(fā)明的第二方面,一種設(shè)備包含:芯片堆疊結(jié)構(gòu),其包含彼此上下堆疊的第一存儲器芯片及第二存儲器芯片;及接口芯片,其耦合到芯片堆疊結(jié)構(gòu)。第一存儲器芯片包含第一端子及第二端子及多個第一存儲器單元。第二存儲器芯片包含第三端子、第四端子及第五端子。第一存儲器芯片及第二存儲器芯片彼此上下堆疊,使得第一存儲器芯片的第二端子電連接到第二存儲器芯片的第五端子。接口芯片包含第六端子、第七端子及第八端子且耦合到芯片堆疊結(jié)構(gòu),使得接口芯片的第六端子、第七端子及第八端子電連接到第二存儲器芯片的第三端子、第四端子及第五端子,第二端子耦合到第一存儲器芯片的第一命令解碼器電路,且第四端子耦合到第二存儲器芯片的第二命令解碼器電路。第一命令解碼器電路及第二命令解碼器電路彼此獨立工作。
根據(jù)本發(fā)明的第三方面,一種設(shè)備包含:接口芯片,其包含振蕩器電路以提供振蕩器信號;第一存儲器芯片,在其上響應(yīng)于在第一節(jié)點處供應(yīng)的第一刷新啟用信號及在第二節(jié)點處供應(yīng)的第一振蕩器啟用信號而執(zhí)行第一刷新操作;第二存儲器芯片,在其上響應(yīng)于在第三節(jié)點處供應(yīng)的第二刷新啟用信號及在第四節(jié)點處供應(yīng)的第二振蕩器啟用信號而執(zhí)行第二刷新操作。第一節(jié)點及第三節(jié)點經(jīng)配置以從接口芯片彼此獨立接收第一刷新啟用信號及第二刷新啟用信號。第二節(jié)點及第四節(jié)點經(jīng)配置以基于振蕩器信號在彼此不同的時序中接收第一振蕩器啟用信號及第二振蕩器啟用信號,使得即使當(dāng)?shù)谝还?jié)點及第三節(jié)點同時接收第一刷新啟用信號及第二刷新啟用信號時,仍在彼此不同的時序中執(zhí)行第一刷新操作及第二刷新操作。
附圖說明
圖1說明根據(jù)第一實施例的高帶寬存儲器的實例。
圖2說明根據(jù)第一實施例的具有高帶寬存儲器及圖形處理單元的實例結(jié)構(gòu)。
圖3說明根據(jù)第一實施例的接口裸片的電路的實例。
圖4說明根據(jù)第二實施例的高帶寬存儲器的實例。
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