[發(fā)明專利]數(shù)據(jù)傳輸系統(tǒng)、數(shù)據(jù)存儲系統(tǒng)有效
| 申請?zhí)枺?/td> | 202010858182.1 | 申請日： | 2020-08-24 |
| 公開（公告）號： | CN112068467B | 公開（公告）日： | 2022-01-14 |
| 發(fā)明（設(shè)計）人： | 黃國臣;王俊杰;王宇成 | 申請（專利權(quán)）人： | 國微集團(tuán)（深圳）有限公司 |
| 主分類號： | G05B19/042 | 分類號： | G05B19/042 |
| 代理公司： | 深圳市康弘知識產(chǎn)權(quán)代理有限公司 44247 | 代理人： | 尹彥 |
| 地址： | 518000 廣東省深圳市南山區(qū)粵*** | 國省代碼： | 廣東;44 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 數(shù)據(jù)傳輸 系統(tǒng) 數(shù)據(jù) 存儲系統(tǒng) | ||
1.一種數(shù)據(jù)傳輸系統(tǒng)，其特征在于，包括多個順次串聯(lián)的FPGA裝置，所述FPGA裝置包括數(shù)據(jù)采集通道、兩條用于與相鄰的FPGA裝置進(jìn)行連接的雙向數(shù)據(jù)傳輸通道、與接收設(shè)備連接的數(shù)據(jù)發(fā)送通道，用于控制數(shù)據(jù)流向的控制邏輯模塊；
所述控制邏輯模塊包括三個通過配置總線相互連接的通道選擇器；同一個控制邏輯模塊的每一個通道選擇器接收三路的數(shù)據(jù)輸入并控制一路數(shù)據(jù)輸出，所述三路的數(shù)據(jù)輸入分別為數(shù)據(jù)采集通道的一路數(shù)據(jù)輸入以及兩條雙向數(shù)據(jù)傳輸通道中由相鄰的FPGA裝置朝向該控制邏輯模塊所在的FPGA裝置的兩路數(shù)據(jù)輸入；三個通道選擇器控制的一路數(shù)據(jù)輸出分別為數(shù)據(jù)發(fā)送通道的一路輸出以及兩條雙向數(shù)據(jù)傳輸通道中朝向相鄰的FPGA裝置的兩路數(shù)據(jù)輸出。
2.如權(quán)利要求1所述的數(shù)據(jù)傳輸系統(tǒng)，其特征在于，所述接收設(shè)備為存儲器。
3.如權(quán)利要求1所述的數(shù)據(jù)傳輸系統(tǒng)，其特征在于，所述FPGA通過數(shù)據(jù)采集通道與數(shù)據(jù)采集硬件模塊一一對應(yīng)連接。
4.一種數(shù)據(jù)存儲系統(tǒng)，其特征在于，采用了權(quán)利要求1至3任意一項所述的數(shù)據(jù)傳輸系統(tǒng)。
5.如權(quán)利要求4所述的數(shù)據(jù)存儲系統(tǒng)，其特征在于，包括主控FPGA裝置，所述主控FPGA裝置獲取與各FPGA裝置連接的存儲器的剩余容量，生成流向配置信息并發(fā)送給各FPGA裝置。
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