[發明專利]一種相控陣天線數據驗證的方法在審
| 申請號: | 202010771193.6 | 申請日: | 2020-08-04 |
| 公開(公告)號: | CN111913975A | 公開(公告)日: | 2020-11-10 |
| 發明(設計)人: | 王偉;谷濱;胡洋;余鵬;羅烜;郭凡玉 | 申請(專利權)人: | 成都天銳星通科技有限公司 |
| 主分類號: | G06F16/23 | 分類號: | G06F16/23;G06F16/215 |
| 代理公司: | 蘇州吳韻知識產權代理事務所(普通合伙) 32364 | 代理人: | 王銘陸 |
| 地址: | 610041 四川省成都市自由貿易試驗區*** | 國省代碼: | 四川;51 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 相控陣 天線 數據 驗證 方法 | ||
1.一種相控陣天線數據驗證的方法,其特征在于,該種方法包括:
S1、數據讀取:校對系統自相控陣波束控制系統中分段讀取待校準數據,并暫存為校準數據段;
S2、數據比對:所述校對系統在原始數據中提取與讀取到的所述校準數據段相對應的原始數據段,將所述原始數據段與所述校準數據段進行比對,并對不一致的比對結果進行記錄;
S3、重復所述S1和所述S2,直至所有的所述待校準數據分別與所述原始數據中的數據逐一比對驗證后,輸出驗證結果。
2.根據權利要求1所述的相控陣天線數據驗證的方法,其特征在于,所述S1具體包括:
S1-1、數據處理:所述相控陣波束控制系統將所述待校準數據處理為標準格式數據后進行存儲;
S1-2、計算數據地址:自初始地址起,按照預設分段的字節長度對所述待校準數據和所述原始數據進行地址分段;
S1-3、獲取所述校準數據段:所述校對系統按照以預設字節長度分段后的地址對所述相控陣波束控制系統中格式處理后的所述待校準數據進行分段讀取,獲得所述校準數據段;
S1-4、數據暫存:所述校對系統對所述分段校準數據進行暫存。
3.根據權利要求2所述的相控陣天線數據驗證的方法,其特征在于,所述S2具體包括:
S2-1、預設原始數據:在所述校對系統中預存與所述待校準數據格式相同的所述原始數據;
S2-2、獲取所述原始數據段:所述校對系統根據所述預設字節長度,提取所述原始數據中與暫存的所述校準數據段相對應的數據,獲得所述原始數據段;
S2-3、數據比對:所述校對系統將提取到的所述原始數據段與暫存的所述校準數據段進行逐一比對驗證,并記錄比對不一致的結果、及結果對應的數據在所述待校準數據中的位置;
S2-4、緩存清理:暫存的所述校準數據段比對完成后,所述校對系統清除該段數據。
4.根據權利要求1所述的相控陣天線數據驗證的方法,其特征在于,所述S3中的驗證結果具體包括不一致的比對結果,及該結果中的數據分別在所述待校準數據、所述原始數據中的位置。
5.根據權利要求1所述的相控陣天線數據驗證的方法,其特征在于,所述待校準數據包括幅度校準數據和相位校準數據。
6.根據權利要求1-5任意一項所述的相控陣天線數據驗證的方法,其特征在于,所述相控陣波束控制系統包括主控芯片FPGA、校準數據存儲器、數據處理模塊、數據傳輸模塊;所述校準存儲器與所述主控芯片FPGA相連,以存儲所述待校準數據;所述數據處理模塊分別與所述主控芯片FPGA、所述校準數據存儲器相連,以對待校準數據進行數據標準格式的轉換;所述數據傳輸模塊與所述主控芯片FPGA相連,以傳輸所述待校準數據。
7.根據權利要求6所述的相控陣天線數據驗證的方法,其特征在于,所述數據處理模塊包括存儲位數為16bit的十六進制數據轉換單元,以對單個所述待校準數據分別進行十六進制的數據格式轉換,并將轉換后的數據存儲以兩個字節進行存儲。
8.根據權利要求7所述的相控陣天線數據驗證的方法,其特征在于,所述校對系統包括配置有校對軟件的PC機、原始數據存儲器、數據讀取模塊、輸出模塊,所述原始數據存儲器與所述PC機相連,以存儲與所述數據處理模塊處理后的數據格式相同的所述原始數據;所述數據讀取模塊分別與所述PC機、所述數據傳輸模塊通訊連接,以讀取所述待校準數據;所述輸出模塊與所述PC機相連,用于輸出驗證結果。
9.根據權利要求8所述的相控陣天線數據驗證的方法,其特征在于,所述校準數據存儲器為Flash存儲器或SD卡,所述原始數據存儲器為電腦硬盤或者電腦緩存。
10.根據權利要求8所述的相控陣天線數據驗證的方法,其特征在于,所述數據傳輸模塊、所述數據讀取模塊為串口通訊或SPI通訊或網關通訊。
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