[發明專利]存儲電路、驅動芯片和顯示裝置有效
| 申請號： | 202010622721.1 | 申請日： | 2020-06-30 |
| 公開（公告）號： | CN111681689B | 公開（公告）日： | 2022-05-06 |
| 發明（設計）人： | 張鈺磊;秦木金;徐再望 | 申請（專利權）人： | 芯穎科技有限公司 |
| 主分類號： | G11C8/12 | 分類號： | G11C8/12;G09G3/20 |
| 代理公司： | 北京超凡宏宇專利代理事務所(特殊普通合伙) 11463 | 代理人： | 范彥揚 |
| 地址： | 200335 上海*** | 國省代碼： | 上海;31 |
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| 摘要： | |||
| 搜索關鍵詞： | 存儲 電路 驅動 芯片 顯示裝置 | ||
1.一種存儲電路，其特征在于，包括存儲模塊和使能模塊，所述使能模塊包括控制單元和使能單元，所述控制單元與所述使能單元電連接，所述使能單元與所述存儲模塊電連接；
所述存儲模塊包括多個閑置存儲模塊，所述閑置存儲模塊為不需要使用的存儲模塊；
所述控制單元用于獲取第一時鐘信號和第二時鐘信號；
與所述多個閑置存儲模塊對應的多個控制單元用于依據所述第一時鐘信號和所述第二時鐘信號譯碼出閑置觸發信號，并將所述閑置觸發信號提供至對應的使能單元；
與所述多個閑置存儲模塊對應的多個使能單元用于依據所述閑置觸發信號同時向所述多個閑置存儲模塊發送使能信號；
所述多個閑置存儲模塊用于依據所述使能信號同時獲取閑置數據；
與所述多個閑置存儲模塊對應的多個控制單元用于在所述第一時鐘信號和所述第二時鐘信號同時出現上升沿時刻開始，至所述第一時鐘信號和所述第二時鐘信號中后出現下降沿時刻結束的時間段，產生所述閑置觸發信號。
2.如權利要求1所述的存儲電路，其特征在于，所述存儲模塊還包括多個使用存儲模塊，所述使用存儲模塊為需要使用的存儲模塊；
所述控制單元還用于獲取使能觸發信號；
與所述多個使用存儲模塊對應的多個控制單元用于將所述使能觸發信號發送至對應的使能單元；
所述使能單元用于獲取所述第二時鐘信號；
與所述多個使用存儲模塊對應的多個使能單元用于依據所述使能觸發信號和所述第二時鐘信號依次向所述多個使用存儲模塊發送使能信號；
所述多個使用存儲模塊用于依據所述使能信號依次獲取正常數據。
3.如權利要求1所述的存儲電路，其特征在于，所述存儲模塊為寄存器和鎖存器中的一種。
4.如權利要求1所述的存儲電路，其特征在于，所述使能單元為鎖存器。
5.如權利要求1所述的存儲電路，其特征在于，所述控制單元為組合邏輯模塊。
6.一種驅動芯片，其特征在于，包括存儲電路，所述存儲電路包括存儲模塊和使能模塊，所述使能模塊包括控制單元和使能單元，所述控制單元與所述使能單元電連接，所述使能單元與存儲模塊電連接；
所述存儲模塊包括多個閑置存儲模塊，所述閑置存儲模塊為不需要使用的存儲模塊；
所述控制單元用于獲取第一時鐘信號和第二時鐘信號；
與所述多個閑置存儲模塊對應的多個控制單元用于依據所述第一時鐘信號和所述第二時鐘信號譯碼出閑置觸發信號，并將所述閑置觸發信號提供至對應的使能單元；
與所述多個閑置存儲模塊對應的多個使能單元用于依據所述閑置觸發信號同時向所述多個閑置存儲模塊發送使能信號；
所述多個閑置存儲模塊用于依據所述使能信號同時獲取閑置數據；
與所述多個閑置存儲模塊對應的多個控制單元用于在所述第一時鐘信號和所述第二時鐘信號同時出現上升沿時刻開始，至所述第一時鐘信號和所述第二時鐘信號中后出現下降沿時刻結束的時間段，產生所述閑置觸發信號。
7.如權利要求6所述的驅動芯片，其特征在于，所述存儲模塊還包括多個使用存儲模塊，所述使用存儲模塊為需要使用的存儲模塊；
所述控制單元還用于獲取使能觸發信號；
與所述多個使用存儲模塊對應的多個控制單元用于將所述使能觸發信號發送至對應的使能單元；
所述使能單元用于獲取所述第二時鐘信號；
與所述多個使用存儲模塊對應的多個使能單元用于依據所述使能觸發信號和所述第二時鐘信號依次向所述多個使用存儲模塊發送使能信號；
所述多個使用存儲模塊用于依據所述使能信號依次獲取正常數據。
8.一種顯示裝置，其特征在于，包括權利要求6-7任意一項所述的驅動芯片。
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