[發(fā)明專利]一種SOC中模塊接口時(shí)序的優(yōu)化方法有效
| 申請(qǐng)?zhí)枺?/td> | 202010002949.0 | 申請(qǐng)日： | 2020-01-02 |
| 公開(kāi)（公告）號(hào)： | CN111221752B | 公開(kāi)（公告）日： | 2021-07-23 |
| 發(fā)明（設(shè)計(jì)）人： | 王飛;丁軍鋒;張少華;馬卓;田金峰;張明;郭御風(fēng) | 申請(qǐng)（專利權(quán)）人： | 飛騰信息技術(shù)有限公司 |
| 主分類號(hào)： | G06F13/12 | 分類號(hào)： | G06F13/12;G06F13/20;G06F15/78 |
| 代理公司： | 長(zhǎng)沙軒榮專利代理有限公司 43235 | 代理人： | 李喆 |
| 地址： | 300450 天津市濱海新*** | 國(guó)省代碼： | 天津;12 |
| 權(quán)利要求書(shū)： | 查看更多 | 說(shuō)明書(shū)： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 soc 模塊 接口 時(shí)序 優(yōu)化 方法 | ||
1.一種SOC中模塊接口時(shí)序的優(yōu)化方法，對(duì)于所述SOC中任意模塊，獲取其內(nèi)寄存器的輸入邏輯和輸出邏輯，及所述內(nèi)寄存器通過(guò)接口連接的外寄存器的外邏輯，其特征在于，所述優(yōu)化方法包括以下步驟：
步驟1，設(shè)置所有邏輯單元的權(quán)重為此邏輯單元的輸入端個(gè)數(shù)，計(jì)算所述內(nèi)寄存器的輸入邏輯的權(quán)重，內(nèi)寄存器到所述模塊內(nèi)有多條路徑，獲取所述輸入邏輯內(nèi)的所有的時(shí)序路徑中最大的總權(quán)重，設(shè)置為b_max；
步驟2，計(jì)算內(nèi)寄存器的輸出邏輯的權(quán)重，獲得內(nèi)寄存器到接口最大的總權(quán)重，設(shè)置為a_max；
步驟3，再計(jì)算內(nèi)寄存器通過(guò)接口連接的外寄存器的外邏輯的權(quán)重，獲得C區(qū)的外寄存器到接口的所有路徑上的最大總體權(quán)重，設(shè)置為c_max；
步驟4，對(duì)b_max、a_max及c_max進(jìn)行比較，計(jì)算得到內(nèi)寄存器相對(duì)于接口的一個(gè)預(yù)估距離；
步驟5，通過(guò)在EDA工具中通過(guò)加region的形式將所述內(nèi)寄存器限制在距離對(duì)應(yīng)接口為所述預(yù)估距離的范圍內(nèi)；
所述步驟4進(jìn)一步包括：內(nèi)寄存器的位置取決于A區(qū)與C區(qū)的權(quán)重比較，也取決于A區(qū)加上C區(qū)作為整體與B區(qū)的權(quán)重比較，將A區(qū)與C區(qū)的權(quán)重比較表達(dá)為a_max-c_max，將A區(qū)加上C區(qū)作為整體與B區(qū)的權(quán)重比較表達(dá)為a_max+c_max-b_max；以接口寄存器的內(nèi)部時(shí)序?yàn)橹兀瑸锳區(qū)加上C區(qū)作為整體與B區(qū)的權(quán)重差值設(shè)置一個(gè)權(quán)重為(a_max+c_max-b_max)×2，為A區(qū)與C區(qū)的權(quán)重差值設(shè)置一個(gè)權(quán)重為(a_max-c_max)×1，得到一個(gè)整體的權(quán)重差值(a_max+c_max-b_max)×2+(a_max-c_max)×1，給定內(nèi)寄存器相對(duì)于選定的對(duì)應(yīng)的接口一個(gè)基準(zhǔn)距離d1，選取所述輸入邏輯的時(shí)序?yàn)榛鶞?zhǔn)計(jì)算，得到內(nèi)寄存器相對(duì)于接口的一個(gè)預(yù)估距離d＝d1×{1-[(a_max+c_max-b_max)×P+(a_max-c_max)×Q]/b}，其中，所述內(nèi)寄存器到模塊內(nèi)部的某一時(shí)序路徑的總權(quán)重b為所有內(nèi)邏輯輸入端個(gè)數(shù)之和，P和Q為根據(jù)模塊的需要調(diào)整的系數(shù)值。
2.根據(jù)權(quán)利要求1所述的一種SOC中模塊接口時(shí)序的優(yōu)化方法，其特征在于，所述基準(zhǔn)距離d1為60um，并且所述基準(zhǔn)距離根據(jù)不同的模塊來(lái)調(diào)整。
3.根據(jù)權(quán)利要求1所述的一種SOC中模塊接口時(shí)序的優(yōu)化方法，其特征在于，所述步驟1進(jìn)一步包括：通過(guò)EDA工具的報(bào)時(shí)序的命令找到內(nèi)寄存器到模塊內(nèi)部的所有相關(guān)的時(shí)序路徑以及路徑上的邏輯單元。
4.根據(jù)權(quán)利要求1所述的一種SOC中模塊接口時(shí)序的優(yōu)化方法，其特征在于，所述步驟2進(jìn)一步包括：通過(guò)EDA工具的報(bào)時(shí)序的命令找到內(nèi)寄存器到接口的所有時(shí)序路徑以及路徑上的邏輯單元。
5.根據(jù)權(quán)利要求1所述的一種SOC中模塊接口時(shí)序的優(yōu)化方法，其特征在于，所述步驟3進(jìn)一步包括：通過(guò)EDA工具的報(bào)時(shí)序的命令找到外寄存器到接口的所有時(shí)序路徑以及路徑上的邏輯單元。
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