[實用新型]一種硬件數字排序電路有效
| 申請號： | 201821620560.7 | 申請日： | 2018-09-30 |
| 公開（公告）號： | CN208796228U | 公開（公告）日： | 2019-04-26 |
| 發明（設計）人： | 趙正偉;趙正輝 | 申請（專利權）人： | 廣西民族大學 |
| 主分類號： | G06F7/08 | 分類號： | G06F7/08 |
| 代理公司： | 重慶為信知識產權代理事務所(普通合伙) 50216 | 代理人： | 藍文苑 |
| 地址： | 530006 廣西壯族*** | 國省代碼： | 廣西;45 |
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| 摘要： | |||
| 搜索關鍵詞： | 比較模塊 輸出端子排 硬件數字 輸出端 分出 排序 輸出 本實用新型 排序電路 送入 電子電路技術 數據選擇器 數值比較器 排序技術 軟件數字 | ||
1.一種硬件數字排序電路，其特征在于：包括輸入端子排和輸出端子排，所述輸入端子排設置有3個輸入端，分別為第一數值輸入端a1、第二數值輸入端a2和第三數值輸入端a3，所述輸出端子排設置有3個輸出端，分別為第一數值輸出端OUT1、第二數值輸出端OUT2和第三數值輸出端OUT3，所述第一數值輸入端a1與第一比較模塊的第一輸入端連接，所述第一比較模塊的第一輸出端與第三比較模塊的第一輸入端連接，所述第三比較模塊的第一輸出端與第一數值輸出端OUT1連接，所述第二數值輸入端a2與第一比較模塊的第二輸入端連接，所述第一比較模塊的第二輸出端與第二比較模塊的第一輸入端連接，所述第二比較模塊的第一輸出端與第三比較模塊的第二輸入端連接，所述第三比較模塊的第二輸出端與第二數值輸出端OUT2連接，所述第三數值輸入端a3與第二比較模塊的第二輸入端連接，所述第二比較模塊的第二輸出端與第三數值輸出端OUT3連接。
2.根據權利要求1所述的一種硬件數字排序電路，其特征在于：所述第一比較模塊包括第一數值比較器A1、第一數據選擇器D1和第二數據選擇器D2，所述第一數值輸入端a1第一路與所述第一數值比較器A1的第一輸入端連接，所述第一數值輸入端a1第二路與所述第二數據選擇器D2的第一輸入端0連接，所述第一數值輸入端a1第三路與所述第一數據選擇器D1的第二輸入端1連接；
所述第二數值輸入端a2第一路與所述第一數值比較器A1的第二輸入端連接，所述第二數值輸入端a2第二路與所述第一數據選擇器D1的第一輸入端0連接，所述第二數值輸入端a2第三路與所述第二數據選擇器D2的第二輸入端1連接，所述第一數值比較器A1輸出端分別與所述第一數據選擇器D1、第二數據選擇器D2的選擇端連接；
所述第一數值比較器A1的第一輸入端、第二輸入端作為所述第一比較模塊的第一輸入端、第二輸入端；
所述第一數據選擇器D1的輸出端作為所述第一比較模塊的第一輸出端；
所述第二數據選擇器D2的輸出端作為所述第一比較模塊的第二輸出端。
3.根據權利要求1所述的一種硬件數字排序電路，其特征在于：所述第二比較模塊包括第二數值比較器A2、第三數據選擇器D3和第四數據選擇器D4，所述第三數值輸入端a3第一路與所述第二數值比較器A2的第二輸入端連接，所述第三數值輸入端a3第二路與所述第三數據選擇器D3的第一輸入端0連接，所述第三數值輸入端a3第三路與所述第四數據選擇器D4的第二輸入端1連接；
所述第一比較模塊的第二數據選擇器D2輸出端第一路與所述第二數值比較器A2的第一輸入端連接，所述第二數據選擇器D2輸出端第二路與所述第四數據選擇器D4的第一輸入端0連接，所述第二數據選擇器D2輸出端第三路與所述第三數據選擇器D3的第二輸入端1連接，所述第二數值比較器A2輸出端分別與所述第三數據選擇器D3、第四數據選擇器D4的選擇端連接，所述第四數據選擇器D4輸出端與第三數值輸出端OUT3連接；
所述第二數值比較器A2的第一輸入端、第二輸入端作為所述第二比較模塊的第一輸入端、第二輸入端；
所述第三數據選擇器D3的輸出端作為所述第二比較模塊的第一輸出端；
所述第四數據選擇器D4的輸出端作為所述第二比較模塊的第二輸出端。
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