[實用新型]一種可在線升級的FPGA主動SPI配置電路有效
| 申請號： | 201820242753.7 | 申請日： | 2018-02-09 |
| 公開（公告）號： | CN207833288U | 公開（公告）日： | 2018-09-07 |
| 發明（設計）人： | 林為秀;郭露露 | 申請（專利權）人： | 北京東遠潤興科技有限公司 |
| 主分類號： | G05B19/042 | 分類號： | G05B19/042 |
| 代理公司： | 北京信遠達知識產權代理事務所(普通合伙) 11304 | 代理人： | 魏曉波 |
| 地址： | 100085 北京市海*** | 國省代碼： | 北京;11 |
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| 摘要： | |||
| 搜索關鍵詞： | 模擬開關芯片 在線升級 輸入/輸出管腳 編程控制 配置電路 升級程序 連通 使能信號 寫入 芯片 輸出 申請 | ||
1.一種可在線升級的FPGA主動SPI配置電路，其特征在于，包括：
FPGA芯片、模擬開關芯片和SPI Flash芯片；
其中，所述FPGA芯片與所述模擬開關芯片相連，所述模擬開關芯片與所述SPI Flash芯片相連；
在所述FPGA芯片向所述模擬開關芯片輸出第一電平使能信號的情況下，所述模擬開關芯片連通所述FPGA芯片的用戶輸入/輸出管腳和所述SPI Flash芯片。
2.根據權利要求1所述的電路，其特征在于，所述模擬開關芯片具有選擇管腳；
所述FPGA芯片的第一用戶輸入/輸出管腳與所述模擬開關芯片的所述選擇管腳相連，并通過第一預設阻值的電阻接地。
3.根據權利要求2所述的電路，其特征在于，所述第一預設阻值為1k歐。
4.根據權利要求2所述的電路，其特征在于，所述模擬開關芯片還具有：第一管腳和第二管腳；
其中，所述第一管腳與所述FPGA芯片的時鐘信號輸出管腳CCLK相連；
所述第二管腳與所述FPGA芯片的第二用戶輸入/輸出管腳相連。
5.根據權利要求4所述的電路，其特征在于，所述模擬開關芯片還具有：第三管腳；
所述第三管腳與所述SPI Flash芯片的時鐘驅動信號輸入管腳相連。
6.根據權利要求5所述的電路，其特征在于，所述在所述FPGA芯片向所述模擬開關芯片輸出第一電平使能信號的情況下，所述模擬開關芯片連通所述FPGA芯片的用戶輸入/輸出管腳和所述SPI Flash芯片包括：
在所述第一用戶輸入/輸出管腳向所述模擬開關芯片的所述選擇管腳輸出第一電平值的情況下，所述模擬開關芯片連通所述第二用戶輸入/輸出管腳和所述時鐘驅動信號輸入管腳。
7.根據權利要求6所述的電路，其特征在于，在所述第一用戶輸入/輸出管腳為高阻態的情況下，所述模擬開關芯片連通所述FPGA芯片的時鐘信號輸出管腳CCLK和所述時鐘驅動信號輸入管腳。
8.根據權利要求4所述的電路，其特征在于，所述FPGA芯片的第三用戶輸入/輸出管腳與遠程通信接口相連。
9.根據權利要求1-8任一項所述的電路，其特征在于，所述FPGA芯片的數據輸出管腳與所述SPI Flash芯片的數據輸入管腳相連；
所述FPGA芯片的數據輸入管腳與所述SPI Flash芯片的數據輸出管腳相連；
所述FPGA芯片的使能信號輸出管腳與所述SPI Flash芯片的片選選擇管腳相連，并通過第二預設阻值的電阻上拉到電源。
10.根據權利要求1-8任一項所述的電路，其特征在于，所述FPGA芯片為塞靈思XilinxFPGA芯片。
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