[實用新型]高頻同步系統及包含其的同步加速器設備有效
| 申請號： | 201820198511.2 | 申請日： | 2018-02-05 |
| 公開（公告）號： | CN207835897U | 公開（公告）日： | 2018-09-07 |
| 發明（設計）人： | 楊建成;申國棟;夏佳文;倪發福;王彥瑜;許哲;殷達鈺;高大慶;上官靖斌;盛麗娜;叢巖 | 申請（專利權）人： | 中國科學院近代物理研究所 |
| 主分類號： | H05H13/04 | 分類號： | H05H13/04 |
| 代理公司： | 中科專利商標代理有限責任公司 11021 | 代理人： | 張宇園 |
| 地址： | 730000 甘*** | 國省代碼： | 甘肅;62 |
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| 摘要： | |||
| 搜索關鍵詞： | 加速器 前級 零相位 過零比較電路 同步加速器 高頻波形 過零比較 同步系統 周長 配置 本實用新型 電源控制器 觸發信號 符合信號 時鐘同步 輸出延時 主控制器 輸出 磁鐵 堆積 | ||
1.一種高頻同步系統，其特征在于，包括：
前級加速器過零比較電路，配置為輸入前級加速器的高頻波形信號，輸出過零比較后的前級加速器的零相位；
后級加速器過零比較電路，配置為輸入后級加速器的高頻波形信號，輸出過零比較后的后級加速器的零相位；
主控制器FPGA，輸入前級加速器的零相位和后級加速器的零相位，還輸入事例觸發信號，配置為分別輸出延時后的符合信號至前級加速器和后級加速器的沖擊磁鐵（Kicker）電源控制器。
2.根據權利要求1所述的高頻同步系統，其特征在于，還包括輔助控制器，與所述主控制器FPGA耦接，用于主控制器FPGA與連接至輔助控制器的其他設備之間的通信。
3.根據權利要求2所述的高頻同步系統，其特征在于，所述輔助控制器配置為連接一上位機，用于將采集的主控制器FPGA的信號傳送至上位機，還用于將上位機下發的參數傳遞給FPGA。
4.根據權利要求1所述的高頻同步系統，其特征在于，所述主控制器FPGA獲取符合信號包括：捕獲后級同步加速器高頻波形零相位后，經過延時，打開捕獲窗口，如果該時間段內能捕獲到前級同步加速器高頻波形零相位信號，并且事例觸發信號存在，則輸出符合信號。
5.一種高頻同步系統，其特征在于，包括：
主控制器FPGA，配置為輸入前級加速器的零相位和后級加速器的零相位，輸入事例觸發信號，還配置為分別輸出延時后的符合信號至前級加速器和后級加速器；
輔助控制器，與所述主控制器耦接，還配置為連接一上位機，配置為使主控制器FPGA與所述上位機通信。
6.一種同步加速器設備，其特征在于包括：
前級加速器和后級加速器，所述前級同步加速器中加速完成的束團引出，注入后級同步加速器；
權利要求1-4任一所述的高頻同步系統。
7.一種同步加速器設備，其特征在于包括：
前級加速器，包括內置的高頻低電平控制現場可編程門陣列，用于確定并輸出前級加速器的零相位；
后級加速器，包括內置的高頻低電平控制現場可編程門陣列，用于確定并輸出后級加速器的零相位，所述前級加速器中的加速完成的束團引出后注入后級加速器；
權利要求5所述的高頻同步系統。
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