[發明專利]一種優化PCB高速鏈路阻抗連續性的方法在審
| 申請號： | 201810540669.8 | 申請日： | 2018-05-30 |
| 公開（公告）號： | CN108684137A | 公開（公告）日： | 2018-10-19 |
| 發明（設計）人： | 榮世立 | 申請（專利權）人： | 鄭州云海信息技術有限公司 |
| 主分類號： | H05K1/02 | 分類號： | H05K1/02 |
| 代理公司： | 暫無信息 | 代理人： | 暫無信息 |
| 地址： | 450018 河南省鄭州市*** | 國省代碼： | 河南;41 |
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| 摘要： | |||
| 搜索關鍵詞： | 電容 高速鏈路 阻抗連續性 接收卡 主板 時域反射計 擺放位置 優化 鏈路 連接器連接 調整電容 對比結果 仿真結果 損耗特性 信號傳輸 整體阻抗 最佳位置 發射端 接收端 阻抗 | ||
【權利要求書】：
1.一種優化PCB高速鏈路阻抗連續性的方法，其特征在于，所述PCB高速鏈路包括主板和接收卡，所述主板與接收卡通過連接器連接，所述主板包括發射端與電容，所述接收卡包括接收端；
所述方法包括以下步驟：
調整電容位置，并針對電容不同位置進行時域反射計仿真；
根據仿真結果對比電容不同位置下，所述PCB高速鏈路阻抗、損耗特性情況；
根據對比結果，確定電容最佳位置。
2.根據權利要求1所述的優化PCB高速鏈路阻抗連續性的方法，其特征在于，所述調整電容位置具體為調整電容與連接器距離。
3.根據權利要求2所述的優化PCB高速鏈路阻抗連續性的方法，其特征在于，所述PCB高速鏈路中，發射端與電容通過引出線L1、主板主走線L2相連，電容與連接器通過連接線L3相連，連接器與接收端通過連接線L4相連。
4.根據權利要求3所述的優化PCB高速鏈路阻抗連續性的方法，其特征在于，L2和L3的總長度不變。
5.根據權利要求4所述的優化PCB高速鏈路阻抗連續性的方法，其特征在于，調整電容與連接器距離為改變L2和L3的長度。
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