[發明專利]一種陣列基板行驅動單元、電路以及液晶顯示面板在審
| 申請號: | 201810203482.9 | 申請日: | 2018-03-13 |
| 公開(公告)號: | CN108492789A | 公開(公告)日: | 2018-09-04 |
| 發明(設計)人: | 陳仁祿;曾勉 | 申請(專利權)人: | 深圳市華星光電半導體顯示技術有限公司 |
| 主分類號: | G09G3/36 | 分類號: | G09G3/36;G09G3/20 |
| 代理公司: | 廣州三環專利商標代理有限公司 44202 | 代理人: | 郝傳鑫;熊永強 |
| 地址: | 518132 廣東省深*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 電平信號 下拉模塊 陣列基板行驅動單元 上拉 下拉 第一端 液晶顯示面板 柵極信號 控制端 輸出端 輸入端 線連接 自舉 電路 時鐘信號線 水平掃描線 充電效率 控制模塊 | ||
本發明實施例公開了一種陣列基板行驅動單元、電路以及液晶顯示面板,陣列基板行驅動單元的上拉控制模塊的輸出端、上拉模塊的控制端、下拉維持模塊的第一端、下拉模塊的第一端、信號下傳模塊的控制端與自舉模塊的第一端連接于柵極信號點,下拉維持模塊的第二端、下拉模塊的第二端、自舉模塊的第二端以及上拉模塊的輸出端與水平掃描線連接,下拉維持模塊的第三端以及下拉模塊的第三端與第一電平信號線連接,下拉維持模塊的第四端以及下拉模塊的第四端與第二電平信號線連接,上拉模塊的輸入端以及信號下傳模塊的輸入端與時鐘信號線連接;第一電平信號線的電壓小于第二電平信號線的電壓。本發明實施例可以縮短柵極信號的下降時間,提升充電效率。
技術領域
本發明涉及電子技術領域,尤其涉及一種陣列基板行驅動單元、電路以及液晶顯示面板。
背景技術
陣列基板行驅動(Gate Driver On Array,GOA)技術,是一種將薄膜晶體管(ThinFilm Transistor,TFT)的柵極掃描驅動電路制作在陣列基板上,以替代外接硅芯片制作的驅動芯片的一種技術。由于GOA電路可直接制作在面板周圍,如此不但可以降低液晶顯示器(Liquid Crystal Display,LCD)的面板的邊框厚度,簡化制程工藝,還可以降低產品成本,提高液晶面板的集成度。
現有的GOA電路,通常包括級聯的多個GOA單元,每一級GOA單元包括上拉控制電路、上拉電路、下傳電路、下拉電路、自舉電容和下拉維持電路以及負責電位抬升的自舉(Boast)電容。其中,上拉控制電路負責控制所述上拉電路的打開,一般連接前面一級GOA單元傳遞過來的下傳信號或者Gate信號;所述上拉電路主要負責將輸入的時鐘信號(Clock,CK)輸出為柵極(Gate)信號;所述下拉電路負責在輸出掃描驅動信號后,快速將該掃描驅動信號(也即是TFT柵極的電位)拉低為低電平,即關閉Gate信號;所述下拉維持電路則主要負責將掃描驅動信號和上拉電路的Gate信號(通常稱為Q點)維持在關閉狀態(即負電位),通常有兩個下拉維持模塊交替作用;所述自舉電容則負責Q點的二次抬升。
GOA電路結構實際輸出的Gate信號是決定GOA性能的關鍵因素之一,Gate信號波形可以分為低電壓階段、第一高電壓和第二高電壓階段,在上述第二高電壓階段,Gate信號波形的上升時間(Rising Time)也就是上升到第二高電壓階段的時長,下降時間(FallingTime)也就是第二高壓階段降到低電壓階段的時長,由于Gate信號波形的上升時間與下降時間不夠短,縮短了維持在第二高電壓階段高電平的時間,會影響對水平掃描線上的充電效率,尤其是在使用三柵極晶體管(Tri-Gate)架構下的柵極驅動電路,有效充電時間較短。
發明內容
本發明實施例提供一種陣列基板行驅動單元、電路以及液晶顯示面板,可以縮短柵極信號的上升時間和下降時間,提升充電效率。
第一方面,本發明實施例提供了一種陣列基板行驅動單元,包括上拉控制模塊、上拉模塊、下拉維持模塊、下拉模塊、信號下傳模塊以及自舉模塊;
所述上拉控制模塊的輸出端、所述上拉模塊的控制端、所述下拉維持模塊的第一端、所述下拉模塊的第一端、所述信號下傳模塊的控制端與所述自舉模塊的第一端連接于柵極信號點,所述下拉維持模塊的第二端、所述下拉模塊的第二端、所述自舉模塊的第二端以及所述上拉模塊的輸出端與水平掃描線連接,所述下拉維持模塊的第三端以及所述下拉模塊的第三端與第一電平信號線連接,所述下拉維持模塊的第四端以及所述下拉模塊的第四端與第二電平信號線連接,所述上拉模塊的輸入端以及所述信號下傳模塊的輸入端與時鐘信號線連接;所述下拉模塊的控制端連接至下一級陣列基板行驅動單元;
所述第一電平信號線的電壓小于所述第二電平信號線的電壓;
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