[實用新型]主控芯片有效
| 申請號： | 201720137764.4 | 申請日： | 2017-02-16 |
| 公開（公告）號： | CN206573894U | 公開（公告）日： | 2017-10-20 |
| 發明（設計）人： | 李延法;王科;鐘前進 | 申請（專利權）人： | 上海新時達電氣股份有限公司;上海辛格林納新時達電機有限公司;上海新時達機器人有限公司 |
| 主分類號： | G05B19/042 | 分類號： | G05B19/042 |
| 代理公司： | 上海晨皓知識產權代理事務所(普通合伙)31260 | 代理人： | 成麗杰 |
| 地址： | 201802 上*** | 國省代碼： | 上海;31 |
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| 摘要： | |||
| 搜索關鍵詞： | 主控 芯片 | ||
1.一種主控芯片，其特征在于，應用于POWERLINK主站，所述主控芯片包括：第一CPU、第二CPU、FPGA模塊；
所述第一CPU、所述第二CPU均與所述FPGA模塊通過內部總線連接；所述主控芯片的內部還設置第一通信接口；所述FPGA模塊通過所述第一通信接口與外部的網卡芯片通信連接。
2.根據權利要求1所述的主控芯片，其特征在于，所述第一CPU、所述第二CPU均通過AXI總線與所述FPGA模塊連接。
3.根據權利要求2所述的主控芯片，其特征在于，所述AXI總線為32比特數據位寬的AXI總線或者64比特數據位寬的AXI總線。
4.根據權利要求1所述的主控芯片，其特征在于，還包括第二通信接口；
所述第一CPU、所述第二CPU、所述FPGA模塊均通過所述第二通信接口與外部的非工業以太網連接。
5.根據權利要求1所述的主控芯片，其特征在于，還包括第三通信接口；
所述第一CPU、所述第二CPU、所述FPGA模塊均通過所述第三通信接口與外部的通用異步收發傳輸器UART連接。
6.根據權利要求1所述的主控芯片，其特征在于，還包括：第四通信接口；
所述第一CPU、所述第二CPU、所述FPGA模塊均通過所述第四通信接口與外部的聯合測試行動組JTAG連接。
7.根據權利要求1所述的主控芯片，其特征在于，還包括：CAN接口；
所述第一CPU、所述第二CPU、所述FPGA模塊均通過所述CAN接口與CAN總線連接。
8.根據權利要求1所述的主控芯片，其特征在于，還包括：通用輸入輸出GPIO接口；
所述第一CPU、所述第二CPU、所述FPGA模塊均通過所述GPIO接口與具備數字量輸入輸出接口的被控設備連接。
9.根據權利要求1所述的主控芯片，其特征在于，還包括：QSPI接口；
所述第一CPU、所述第二CPU、所述FPGA模塊均通過所述QSPI接口與QSPI Flash設備連接。
10.根據權利要求1所述的主控芯片，其特征在于，還包括：USB接口；
所述第一CPU、所述第二CPU、所述FPGA模塊均通過所述USB接口與USB設備連接。
11.根據權利要求1所述的主控芯片，其特征在于，還包括：電源接口；
所述第一CPU、所述第二CPU、所述FPGA模塊均通過所述電源接口與電源連接。
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