[發(fā)明專利]一種數(shù)?；旌衔⑾到y(tǒng)ADC單元動態(tài)參數(shù)測試系統(tǒng)有效
| 申請?zhí)枺?/td> | 201711458673.1 | 申請日： | 2017-12-28 |
| 公開（公告）號： | CN108768394B | 公開（公告）日： | 2022-01-11 |
| 發(fā)明（設(shè)計）人： | 朱志強;馮長磊;李學(xué)武;陳雷;王媛媛;李金潮 | 申請（專利權(quán)）人： | 北京時代民芯科技有限公司;北京微電子技術(shù)研究所 |
| 主分類號： | H03M1/10 | 分類號： | H03M1/10 |
| 代理公司： | 中國航天科技專利中心 11009 | 代理人： | 武瑩 |
| 地址： | 100076 北*** | 國省代碼： | 北京;11 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 數(shù)模 混合 系統(tǒng) adc 單元 動態(tài) 參數(shù) 測試 | ||
1.一種數(shù)?；旌衔⑾到y(tǒng)ADC單元動態(tài)參數(shù)測試系統(tǒng)，其特征在于包括包括：上位機和測試板，其中：
上位機負責(zé)對測試結(jié)果進行顯示和存儲；
測試板包括信號發(fā)生模塊、信號調(diào)理模塊、時鐘產(chǎn)生模塊、微系統(tǒng)ADC單元以及微系統(tǒng)FPGA單元；信號調(diào)理模塊與信號發(fā)生模塊、微系統(tǒng)ADC單元以及微系統(tǒng)FPGA單元相連；時鐘產(chǎn)生模塊與微系統(tǒng)ADC單元以及微系統(tǒng)FPGA單元相連；微系統(tǒng)FPGA單元通過通信接口與上位機相連；
信號發(fā)生模塊使用晶體振蕩器產(chǎn)生一個單音正弦波信號；信號調(diào)理模塊對信號發(fā)生模塊產(chǎn)生的信號進行濾波處理，產(chǎn)生微系統(tǒng)ADC單元輸入信號；時鐘產(chǎn)生模塊由鎖相環(huán)PLL電路產(chǎn)生，為微系統(tǒng)ADC單元及微系統(tǒng)FPGA單元提供時鐘；微系統(tǒng)ADC單元采集由信號發(fā)生模塊產(chǎn)生并由信號調(diào)理模塊處理的輸入信號，將輸入的模擬信號轉(zhuǎn)換為數(shù)字信號；微系統(tǒng)FPGA單元對微系統(tǒng)ADC單元采樣輸出數(shù)據(jù)進行采集、存儲及處理，得出微系統(tǒng)ADC單元的動態(tài)性能參數(shù)，將測試結(jié)果通過USB通信接口上傳至上位機進行顯示及存儲；
所述的微系統(tǒng)FPGA單元包括數(shù)據(jù)采集模塊、數(shù)據(jù)存儲模塊、數(shù)據(jù)處理模塊、過程控制模塊以及通信模塊；
數(shù)據(jù)采集模塊采集微系統(tǒng)ADC單元采樣輸出數(shù)據(jù)并送至數(shù)據(jù)存儲模塊、數(shù)據(jù)處理模塊，數(shù)據(jù)存儲模塊存儲微系統(tǒng)ADC單元采樣輸出數(shù)據(jù)，數(shù)據(jù)處理模塊根據(jù)微系統(tǒng)ADC單元采樣輸出數(shù)據(jù)得出微系統(tǒng)ADC單元的動態(tài)性能參數(shù)并送至通信模塊，通信模塊將微系統(tǒng)ADC單元的動態(tài)性能參數(shù)作為測試結(jié)果，通過USB通信接口上傳至上位機進行顯示及存儲，過程控制模塊實現(xiàn)對數(shù)據(jù)采集模塊、數(shù)據(jù)存儲模塊、數(shù)據(jù)處理模塊、通信模塊的過程控制及調(diào)度。
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