[發明專利]基于流水線結構的安全處理器在審
| 申請號： | 201711082754.6 | 申請日： | 2017-11-06 |
| 公開（公告）號： | CN109753827A | 公開（公告）日： | 2019-05-14 |
| 發明（設計）人： | 汪家祥;吳亞坤;于柏森;李晗璐 | 申請（專利權）人： | 中天安泰（北京）信息技術有限公司 |
| 主分類號： | G06F21/71 | 分類號： | G06F21/71 |
| 代理公司： | 暫無信息 | 代理人： | 暫無信息 |
| 地址： | 100166 北京市*** | 國省代碼： | 北京;11 |
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| 摘要： | |||
| 搜索關鍵詞： | 安全處理器 核心流水線 旁路 審核 流水線結構 指令 處理器核心 新型處理器 計算設備 內部設置 審核結果 高效性 處理器 并行 判定 架構 干預 保證 | ||
1.一種安全處理器，該安全處理器的內部設置有流水線結構的處理器核心，其特征在于，在核心流水線上設置有與所述核心流水線并行工作的旁路審核邏輯電路；
所述旁路審核邏輯電路用于對所述核心流水線上處理的指令進行審核，并利用審核結果判定該指令在所述核心流水線上是否允許提交。
2.根據權利要求1所述的安全處理器，其特征在于，所述核心流水線至少包含譯碼邏輯電路、以及流水級位于所述譯碼邏輯電路之后的提交邏輯電路；
所述旁路審核邏輯電路被配置為旁路架設在所述核心流水線上的所述譯碼邏輯電路與所述提交邏輯電路之間的位置。
3.根據權利要求2所述的安全處理器，其特征在于，所述核心流水線上還包括位于所述譯碼邏輯電路與所述提交邏輯電路之間的重排序緩沖邏輯電路；
所述旁路審核邏輯電路的輸入接口被配置在所述譯碼邏輯電路的輸出接口上，所述旁路審核邏輯電路的輸出接口被配置在所述重排序緩沖邏輯電路的輸入接口上。
4.根據權利要求2或3所述的安全處理器，其特征在于，所述旁路審核邏輯電路，具體包括：指令比對單元，用于利用基準值對輸入的指令值進行比對，輸出比對結果；存儲單元，用于向所述指令比對單元提供所述基準值。
5.根據權利要求4所述的安全處理器，其特征在于，所述旁路審核邏輯電路，還包括：指令篩選單元，用于從所述核心流水線上獲取經過譯碼后的指令信息，將指定類型的指令值輸出給所述指令比對單元。
6.根據權利要求4所述的安全處理器，其特征在于，所述存儲單元預留有提供操作系統寫入所述基準值的軟件接口。
7.根據權利要求4所述的安全處理器，其特征在于，所述存儲單元為處理器緩存或寄存器集合。
8.根據權利要求4所述的安全處理器，其特征在于，所述指令值為以下之一或任意組合：源地址、操作數、操作碼。
9.根據權利要求4所述的安全處理器，其特征在于，所述指令比對單元輸出比對結果的表現為對目標指令置標志位，以指示該指令禁止或允許提交。
10.一種計算設備，其特征在于，該計算設備被配置有如權利要求1所述的安全處理器。
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