[發(fā)明專利]具有數(shù)據(jù)保持反饋回路的TSPC觸發(fā)器有效
| 申請?zhí)枺?/td> | 201710751132.1 | 申請日: | 2017-08-28 |
| 公開(公告)號: | CN107528568B | 公開(公告)日: | 2020-08-18 |
| 發(fā)明(設(shè)計(jì))人: | 高靜;周游;徐江濤;史再峰;聶凱明 | 申請(專利權(quán))人: | 天津大學(xué) |
| 主分類號: | H03K3/356 | 分類號: | H03K3/356 |
| 代理公司: | 天津市北洋有限責(zé)任專利代理事務(wù)所 12201 | 代理人: | 劉國威 |
| 地址: | 300072*** | 國省代碼: | 天津;12 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 具有 數(shù)據(jù) 保持 反饋 回路 tspc 觸發(fā)器 | ||
1.一種具有數(shù)據(jù)保持反饋回路的TSPC觸發(fā)器,其特征是,由PMOS管8個(gè),分別是P1、P2、P3、P4、P5、P6、P7、P8;NMOS管7個(gè)分別是N1、N2、N3、N4、N5、N6、N7和3個(gè)反相器INV1、INV2、INV3構(gòu)成,PMOS管P1的柵極和輸入信號D連接,漏極與P2的源極連接,源極和襯底與電源連接;PMOS管P2的柵極接時(shí)鐘信號CLK,源極與P1的漏極連接,漏極與節(jié)點(diǎn)A連接,襯底與電源連接;NMOS管N1的柵極與輸入信號D連接,源極與N2的漏極連接,漏極與節(jié)點(diǎn)A連接,襯底與地連接;NMOS管N2的柵極與復(fù)位信號Rb連接,漏極與N1的源極連接,源極與地連接;PMOS管P3的柵極與復(fù)位信號Rb連接,源極和襯底與電源連接,漏極與節(jié)點(diǎn)A連接;PMOS管P4的柵極與復(fù)位信號R連接,源極和襯底與電源連接,漏極與P5的源極連接;PMOS管P5柵極與時(shí)鐘信號CLK連接,源極與P4的漏極連接,漏極與節(jié)點(diǎn)B連接,襯底接地;NMOS管N3的柵極與節(jié)點(diǎn)A連接,源極與N4的漏極連接,漏極與節(jié)點(diǎn)B連接,襯底接地;NMOS管N4的柵極接時(shí)鐘信號CLK,源極和襯底接地,漏極與N3的源極連接;NMOS管N5的柵極與復(fù)位信號R連接,源極和襯底與地連接,漏極與節(jié)點(diǎn)B連接;PMOS管P6的柵極與節(jié)點(diǎn)B連接,源極和襯底與電源連接,漏極與節(jié)點(diǎn)C連接,NMOS管N6的柵極與時(shí)鐘信號CLK連接,源極與N7的漏極連接,漏極與節(jié)點(diǎn)C連接,襯底接地;NMOS管N7的柵極與節(jié)點(diǎn)B連接,源極和襯底與地連接,漏極與N6的源極連接;PMOS管P7的柵極與復(fù)位信號R連接,源極和襯底與電源連接,漏極與節(jié)點(diǎn)C連接;PMOS管P8的柵極與時(shí)鐘信號CLK連接,源極接反相器INV3的輸出,漏極接節(jié)點(diǎn)C,襯底與電源連接;反相器INV1的輸入接節(jié)點(diǎn)C,輸出接輸出端Q;反相器INV2的輸入接節(jié)點(diǎn)C,輸出接反相器INV3的輸入;反相器INV3的輸入接反相器INV2的輸出,輸出接P8的源極,其中復(fù)位信號Rb和R是一對差分信號,也就是說R為高電平時(shí),Rb為低電平,R為低電平時(shí)Rb為高電平,用來對TSPC的工作狀態(tài)進(jìn)行控制。
2.如權(quán)利要求1所述的具有數(shù)據(jù)保持反饋回路的TSPC觸發(fā)器,其特征是,當(dāng)復(fù)位信號Rb為高電平,R為低電平時(shí),觸發(fā)器為復(fù)位狀態(tài),此時(shí)不管時(shí)鐘信號CLK和輸入D為何值,節(jié)點(diǎn)A為高電平、節(jié)點(diǎn)B為低電平、節(jié)點(diǎn)C為高電平,輸出Q為低電平;當(dāng)復(fù)位信號Rb為低電平,R為高電平時(shí),觸發(fā)器為工作狀態(tài),若輸入信號D為低電平時(shí),時(shí)鐘信號CLK為低電平時(shí),節(jié)點(diǎn)A為高電平、節(jié)點(diǎn)B為高電平、節(jié)點(diǎn)C為高電平,輸出維持復(fù)位時(shí)的的低電平,當(dāng)時(shí)鐘信號CLK由低電平變成高電平時(shí),節(jié)點(diǎn)A為高電平、節(jié)點(diǎn)B為低電平、節(jié)點(diǎn)C為高電平,則輸出Q為低電平;
當(dāng)時(shí)鐘CLK變成低電平,輸入D變成高電平時(shí),節(jié)點(diǎn)A為低電平、節(jié)點(diǎn)B為高電平、節(jié)點(diǎn)C為高電平,輸出Q為低電平,當(dāng)時(shí)鐘變成高電平時(shí),節(jié)點(diǎn)A為低電平、節(jié)點(diǎn)B變成高電平、節(jié)點(diǎn)C為低電平,則輸出Q為高電平。
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