[發(fā)明專利]一種占空比穩(wěn)定電路有效
| 申請?zhí)枺?/td> | 201710124473.6 | 申請日: | 2017-03-03 |
| 公開(公告)號: | CN106911330B | 公開(公告)日: | 2020-12-15 |
| 發(fā)明(設(shè)計(jì))人: | 唐枋;王忠杰;葉楷;殷鵬;陳卓;李世平;舒洲;黃莎琳;李明東;夏迎軍;周喜川;胡盛東;甘平 | 申請(專利權(quán))人: | 重慶湃芯創(chuàng)智微電子有限公司 |
| 主分類號: | H03L7/085 | 分類號: | H03L7/085;H03K5/156 |
| 代理公司: | 暫無信息 | 代理人: | 暫無信息 |
| 地址: | 401332 重慶*** | 國省代碼: | 重慶;50 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 穩(wěn)定 電路 | ||
1.一種占空比穩(wěn)定電路,其特征在于:包括具有兩個輸出端的鑒相器、啟動電路、積分器和具有兩個輸入端壓控延時鏈;鑒相器的其中一個輸出端與啟動電路的輸入端連接,且該輸出端作為所述穩(wěn)定電路的輸出端,鑒相器的另一個輸出端與壓控延時鏈的其中一個輸入端連接,啟動電路的輸出端與積分器的輸入端連接,積分器的輸出端與壓控延時鏈的另一個輸入端連接;鑒相器接收參考時鐘信號CK_REF與壓控延遲鏈的反饋信號CK_VCDL,并完成參考時鐘信號CK_REF與反饋信號CK_VCDL相位差的比較;積分器用于占空比檢測,并將鑒相器輸出信號的占空比信息轉(zhuǎn)化為電壓信息;該電壓信息用于控制壓控延遲鏈的延遲時間,使壓控延遲鏈能夠?qū)崟r地調(diào)整鑒相器兩輸入信號的相位差;啟動電路使時鐘穩(wěn)定電路迅速進(jìn)入鎖定狀態(tài),縮短鎖定時間;所述壓控延遲鏈包括MOS管M1、MOS管M2、MOS管M3、MOS管M4、MOS管M5、電容C1和電流源,所述MOS管M1的源極接電源,MOS管M1的漏極分別與MOS管M2的漏極、MOS管M4的漏極、電容C1的一端連接,電容的另一端接地,MOS管M2的源極與MOS管M3的漏極連接,MOS管M3的源極接地,MOS管M4的源極接地,MOS管M4的柵極與MOS管M5的柵極連接,MOS管M5的源極接地,MOS管M5的漏極分別與MOS管M5的柵極、電源流的輸出端連接,電流源的輸出端接電源;所述MOS管M1的柵極與MOS管M2的柵極接鑒相器的輸出信號,MOS管M3的柵極與積分器的輸出端連接;所述啟動電路包括第五與非門(7)、第六與非門(8)、非門、和D觸發(fā)器U1,所述非門的輸入端接參考時鐘信號CK_REF,非門的輸出端與U1的其中一個輸入端連接,第五與非門的其中一個輸入端接反饋信號CK_VCDL,第五與非門的另一個輸入端接穩(wěn)定電路的輸出信號CK,第五與非門的輸出端與U1的另一個輸入端連接,U1的輸出端與第六與非門的其中一個輸入端連接,第六與非門的另一個輸入端接輸出信號CK,第六與非門的輸出端與積分器的輸入端連接。
2.根據(jù)權(quán)利要求1所述的一種占空比穩(wěn)定電路,其特征在于:所述鑒相器包括第一延時器(1)、第二延時器(2)、第一與非門(3)、第二與非門(4)、第三與非門(5)和第四與非門(6),所述第一與非門的其中一個輸入端與第一延時器的輸入端連接,第一延時器的輸出端與第一與非門的另一個輸入端連接,第一與非門的輸出端與第三與非門的其中一個輸入端連接,第二與非門的其中一個輸入端與第二延時器的輸入端連接,第二延時器的輸出端與第二與非門的另一個輸入端連接,第二與非門的輸出端與第四與非門的其中一個輸入端連接,第三與非門的另一個輸入端與第四與非門的輸出端連接,第四與非門的另一個輸入端與第三與非門的輸出端連接;所述第一延時器的輸入端接經(jīng)過時鐘緩沖器的輸出時鐘信號,所述第二延時器的輸入端接壓控延遲鏈的輸出信號。
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