[發明專利]用于支持低編碼速率的TURBO編碼在審
| 申請號: | 201680080815.2 | 申請日: | 2016-06-23 |
| 公開(公告)號: | CN108604904A | 公開(公告)日: | 2018-09-28 |
| 發明(設計)人: | 阿列克謝·達維多夫;德布迪普·查特吉;格里戈里·埃爾莫拉耶夫 | 申請(專利權)人: | 英特爾公司 |
| 主分類號: | H03M13/29 | 分類號: | H03M13/29;H03M13/39 |
| 代理公司: | 北京東方億思知識產權代理有限責任公司 11258 | 代理人: | 宗曉斌 |
| 地址: | 美國加利*** | 國省代碼: | 美國;US |
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| 摘要: | |||
| 搜索關鍵詞: | 輸入數據塊 虛擬代碼 位序列 無線電信道 原始數據塊 奇偶校驗 輸出 附加位 去除 信道 噪聲 發送 創建 | ||
1.一種用于用戶設備(UE)的基帶處理器的裝置,所述裝置包括用于進行以下操作的電路:
處理輸入數據流以獲得特定大小的輸入塊;
將附加數據插入到所述輸入塊以獲得大小大于所述輸入塊的所述特定大小的虛擬代碼塊;
使用turbo編碼技術對所述虛擬代碼塊進行編碼以獲得經編碼的代碼塊,所述經編碼的代碼塊包括系統部分和奇偶校驗部分;
從所述經編碼的代碼塊的所述系統部分中去除所述附加數據,以獲得包括去除了所述附加數據的所述系統部分和所述奇偶校驗部分的輸出數據塊;以及
輸出所述輸出數據塊,以通過信道進行處理和傳輸。
2.根據權利要求1所述的裝置,其中,所述電路還用于:
將所述附加數據生成為全零位的序列或全一位的序列。
3.根據權利要求1所述的裝置,其中,所述電路還用于:
將所述附加數據生成為偽隨機位序列。
4.根據權利要求1、2或3中任一項所述的裝置,其中,將所述附加數據插入到所述輸入塊包括在所述輸入塊的開頭或結尾處插入所述附加數據。
5.根據權利要求1、2或3中任一項所述的裝置,其中,將所述附加數據插入到所述輸入塊包括在所述輸入塊內偽隨機地插入所述附加數據。
6.根據權利要求5所述的裝置,其中,所述附加數據的偽隨機插入是基于基于子幀或幀索引獲得的索引值的。
7.根據權利要求2或3中任一項所述的裝置,其中,將所述附加數據插入到所述輸入塊包括在所述輸入塊內的相等間隔的位置處插入所述附加數據。
8.根據權利要求1、2或3中任一項所述的裝置,其中,所述turbo編碼技術包括系統卷積turbo碼。
9.根據權利要求1、2或3中任一項所述的裝置,其中,所述電路還用于:
基于以下內容確定所述虛擬代碼塊的大小:
b=a*(1/R–1)/2
其中,b是所述虛擬代碼塊的大小,a是所述輸入塊的大小,并且R是編碼速率。
10.一種計算機可讀介質,包含用于使得與通信設備相關聯的一個或多個處理器進行以下操作的程序指令:
處理輸入數據流以獲得特定大小的輸入塊;
將附加數據插入到所述輸入塊以獲得大小大于所述輸入塊的所述特定大小的虛擬代碼塊;
使用turbo編碼技術對所述虛擬代碼塊進行編碼以獲得經編碼的代碼塊,所述經編碼的代碼塊包括系統部分和奇偶校驗部分;
處理所述經編碼的代碼塊以獲得輸出數據塊,所述輸出數據塊包括沒有所述附加數據的所述經編碼的代碼塊的所述系統部分和所述奇偶校驗部分;以及
輸出所述輸出數據塊,以通過信道進行處理和傳輸。
11.根據權利要求10所述的計算機可讀介質,其中,所述通信設備包括用戶設備(UE)設備或演進型節點B(eNB)設備。
12.根據權利要求10或11所述的計算機可讀介質,其中,所述程序指令還使得所述一個或多個處理器進行以下操作:
通過在所述輸入塊的開頭或結尾處插入所述附加數據來將所述附加數據插入到所述輸入塊。
13.根據權利要求10或11所述的計算機可讀介質,其中,所述程序指令還使得所述一個或多個處理器進行以下操作:
通過將所述附加數據偽隨機地插入在所述輸入塊內來將所述附加數據插入到所述輸入塊。
14.根據權利要求13所述的計算機可讀介質,其中,所述附加數據的偽隨機插入是基于基于子幀或幀索引獲得的索引值的。
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