[發明專利]一種基于VHDL可控制起停傳輸移位寄存器操作方法有效
| 申請號： | 201611154203.1 | 申請日： | 2016-12-14 |
| 公開（公告）號： | CN106782662B | 公開（公告）日： | 2019-09-24 |
| 發明（設計）人： | 李羚梅;張鵬泉;范玉進;尚進;崔俊鵬;汪震;劉彩虹 | 申請（專利權）人： | 天津光電通信技術有限公司 |
| 主分類號： | G11C19/28 | 分類號： | G11C19/28 |
| 代理公司： | 天津諾德知識產權代理事務所(特殊普通合伙) 12213 | 代理人： | 欒志超 |
| 地址： | 300211 天*** | 國省代碼： | 天津;12 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 基于 vhdl 控制 傳輸 移位寄存器 操作方法 | ||
【權利要求書】：
1.一種基于VHDL可控制起停傳輸移位寄存器操作方法，包括步驟：
步驟一：初始化；
步驟二：掃描讀數；
步驟三：判斷是否為幀頭；
步驟四：執行幀頭是操作或者幀頭否操作；
所述步驟四的幀頭否操作是重復執行一次步驟二掃描讀數；
所述步驟四的幀頭是操作包括：
S1：打開控制信號；
S2：移位寄存；
S3：按bit讀數；
S4：判斷bit位是否是第8位；
S5：執行bit第8位是操作或者bit第8位否操作。
2.根據權利要求1所述寄存器操作方法，其特征在于：所述bit第8位否操作是繼續所述按bit讀數的步驟。
3.根據權利要求1所述寄存器操作方法，其特征在于：所述bit第8位是操作包括：
S6：所述bit的下一bit數據進行所述移位寄存；
S7：所述bit數據并行輸出；
S8：幀尾判斷；
S9：執行幀尾是操作或者幀尾否操作。
4.根據權利要求3所述寄存器操作方法，其特征在于：所述幀尾否操作是繼續執行所述bit數據并行輸出。
5.根據權利要求3所述寄存器操作方法，其特征在于：所述幀尾是操作包括：
S10：:所述幀傳輸停止；
S11：關閉控制信號；
S12：所述幀的下一幀掃描讀數。
6.根據權利要求5所述寄存器操作方法，其特征在于：所述S10和所述S11的執行無先后順序。
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