[發明專利]FC鏈路彈性緩沖區電路有效
| 申請號: | 201611139615.8 | 申請日: | 2016-12-12 |
| 公開(公告)號: | CN108462655B | 公開(公告)日: | 2021-07-16 |
| 發明(設計)人: | 李攀;楊海波;王玉歡;霍衛濤;蔡葉芳 | 申請(專利權)人: | 中國航空工業集團公司西安航空計算技術研究所 |
| 主分類號: | H04L12/879 | 分類號: | H04L12/879;H04L12/931 |
| 代理公司: | 中國航空專利中心 11008 | 代理人: | 杜永保 |
| 地址: | 710000 *** | 國省代碼: | 陜西;61 |
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| 摘要: | |||
| 搜索關鍵詞: | fc 彈性 緩沖區 電路 | ||
1.一種FC鏈路彈性緩沖區電路,其特征在于,包括寫數據接口(1)、IDLE檢測電路(2)、寫指針控制電路(3)、第一格雷碼轉換電路(4-1)、第二格雷碼轉換電路(4-2)、第三格雷碼轉換電路(4-3)、IDLE標志存儲器電路(5)、數據存儲器電路(6)、讀寫指針比較電路(7)、當前數據是IDLE檢測電路(8)、下一個數據是IDLE檢測電路(9)、讀指針加3電路(10)、讀指針控制電路(11)、讀數據接口(12),
其中寫數據接口(1)、IDLE檢測電路(2)、寫指針控制電路(3)、第一格雷碼轉換電路(4-1)、IDLE標志存儲器電路(5)、數據存儲器電路(6),完成寫時鐘域下,寫數據接口(1)輸入數據到IDLE標志存儲器電路(5)和數據存儲器電路(6)的寫入操作;
第二格雷碼轉換電路(4-2)、第三格雷碼轉換電路(4-3)、IDLE標志存儲器電路(5)、數據存儲器電路(6)、讀寫指針比較電路(7)、當前數據是IDLE檢測電路(8)、下一個數據是IDLE檢測電路(9)、讀指針加3電路(10)、讀指針控制電路(11)以及讀數據接口(12),完成讀時鐘域下,有效數據從讀數據接口(12)輸出操作,通過僅在讀時鐘域對讀數據指針進行控制,實現接收端口數據緩沖的彈性控制,防止緩沖區的上溢和下溢造成的數據丟失;
所述IDLE標志存儲器電路(5)在第二格雷碼轉換電路(4-2)輸出的讀指針rprt信號以及第三格雷碼轉換電路(4-3)輸出的讀指針rprt_pre信號控制下,輸出數據到當前數據是IDLE檢測電路(8)、下一個數據是IDLE檢測電路(9);
所述數據存儲器電路(6)輸出讀數據到讀數據接口(12);
所述讀寫指針比較電路(7)輸出即將滿信號a_full、即將空信號a_empty到讀指針控制電路(11);
所述當前數據是IDLE檢測電路(8)輸出DoutIsIdle信號到讀指針控制電路(11);所述下一個數據是IDLE檢測電路(9)輸出DoutNextIsIdle信號到讀指針控制電路(11);所述讀指針加3電路(10)輸出rprtb+3信號到第二格雷碼轉換電路(4-2);
所述第三格雷碼轉換電路(4-3)輸出轉換后的讀指針到IDLE標志存儲器電路(5)、數據存儲器電路(6)以及讀寫指針比較電路(7);
所述讀指針控制電路(11)輸出2進制的讀指針到讀指針加3電路(10)、第三格雷碼轉換電路(4-3);
所述讀數據接口(12 )輸出讀時鐘信號r_clk、讀時鐘域的復位信號r_rst以及讀使能信號r_en到讀指針控制電路(11);輸出讀時鐘信號w_clk到數據存儲器電路(6)。
2.如權利要求1所述的FC鏈路彈性緩沖區電路,其特征在于,所述寫數據接口(1)輸出寫數據信號d_in到IDLE檢測電路(2);寫數據接口(1)輸出寫時鐘信號w_clk、寫時鐘域的復位信號w_rst以及寫使能信號w_en到寫指針控制電路(3),控制寫指針wprtb的變化;寫數據接口(1)輸出寫時鐘信號w_clk、寫時鐘域的復位信號w_rst以及寫數據信號d_in數據存儲器電路(6);
所述IDLE檢測電路(2)將檢測到的IDLE標志位輸出到IDLE標志存儲器電路(5);所述寫指針控制電路(3)輸出寫指針wprtb到第一格雷碼轉換電路(4-1);
所述第一格雷碼轉換電路(4-1)輸出轉換后的格雷碼指針wprt到IDLE標志存儲器電路(5)、數據存儲器電路(6)以及讀寫指針比較電路(7)。
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