[發(fā)明專利]一種連級比較器電路在審
| 申請?zhí)枺?/td> | 201611041495.8 | 申請日: | 2016-11-22 |
| 公開(公告)號: | CN106603048A | 公開(公告)日: | 2017-04-26 |
| 發(fā)明(設(shè)計)人: | 陳璐;張寧;張軒 | 申請(專利權(quán))人: | 上海華力微電子有限公司 |
| 主分類號: | H03K5/24 | 分類號: | H03K5/24;H03M1/46 |
| 代理公司: | 上海天辰知識產(chǎn)權(quán)代理事務(wù)所(特殊普通合伙)31275 | 代理人: | 吳世華,陳慧弘 |
| 地址: | 201210 上海市浦*** | 國省代碼: | 上海;31 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 比較 電路 | ||
1.一種連級比較器電路;其特征在于,包括:
第一預(yù)放大器,用于對接收的輸入信號進行第一級放大;
第二預(yù)放大器,用于對所述第一預(yù)放大器輸出的信號進行第二級放大;
動態(tài)鎖存器,用于在比較狀態(tài)時對所述的第二預(yù)放大器輸出的信號進行比較反轉(zhuǎn);
第一電容和第二電容,串接在所述第一預(yù)放大器和第二預(yù)放大器之間;
第三電容和第四電容,串接在所述第二預(yù)放大器和動態(tài)鎖存器之間;
第一開關(guān)和第二開關(guān),串接在所述第一預(yù)放大器的正輸入端和負輸入端之間;
第三開關(guān),并接在所述第一電容和第三電容之間;
第四開關(guān),并接在所述第二電容和第四電容之間;
第五開關(guān)和第六開關(guān),串接在所述動態(tài)鎖存器的正輸入端和負輸入端之間;
其中,所述電路具有由電平控制且交叉進行的兩種工作狀態(tài),即失調(diào)電壓存儲狀態(tài)和正常比較工作狀態(tài);
當(dāng)進入失調(diào)電壓存儲狀態(tài)時,所述第一開關(guān)、第二開關(guān)、第三開關(guān)、第四開關(guān)、第五開關(guān)和第六開關(guān)同時閉合,且接入共模電平,所述第一預(yù)放大器的正輸入端和負輸入端均輸入相同的共模電平;所述動態(tài)鎖存器的輸出端沒有輸出;
當(dāng)進入比較工作狀態(tài)時,所述第一開關(guān)、第二開關(guān)、第三開關(guān)、第四開關(guān)、第五開關(guān)和第六開關(guān)同時斷開;所述第一預(yù)放大器的正輸入端輸入需比較的電壓信號,所述第一預(yù)放大器的負輸入端輸入標(biāo)準(zhǔn)信號;所述動態(tài)鎖存器的輸出端輸出比較結(jié)果電壓信號。
2.根據(jù)權(quán)利要求1所述的連級比較器電路,其特征在于,所述第一電容和第二電容的電容值相同。
3.根據(jù)權(quán)利要求1所述的連級比較器電路,其特征在于,所述第三電容和第四電容的電容值相同。
4.根據(jù)權(quán)利要求1所述的連級比較器電路,其特征在于,所述第一預(yù)放大器和第二預(yù)放大器均為差分輸入差分輸出的運放。
5.根據(jù)權(quán)利要求1所述的連級比較器電路,其特征在于,所述第一開關(guān)、第二開關(guān)、第三開關(guān)、第四開關(guān)、第五開關(guān)和第六開關(guān)采用相同的開關(guān)。
6.根據(jù)權(quán)利要求5所述的連級比較器電路,其特征在于,所述第一開關(guān)、第二開關(guān)、第三開關(guān)、第四開關(guān)、第五開關(guān)和第六開關(guān)采用消除電荷注入的CMOS開關(guān)。
7.根據(jù)權(quán)利要求1所述的連級比較器電路,其特征在于,所述交叉進行的兩種工作狀態(tài),由外部控制時鐘產(chǎn)生的電平控制。
8.根據(jù)權(quán)利要求1所述的連級比較器電路,其特征在于,所述第一預(yù)放大器和第二預(yù)放大器為單級運放或者多級運放。
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