[發明專利]用于時鐘和數據恢復的裝置和方法有效

申請號：	201610013816.7	申請日：	2016-01-11
公開（公告）號：	CN105786746B	公開（公告）日：	2019-09-17
發明（設計）人：	S·麥克拉肯;J·肯尼;K·泰姆	申請（專利權）人：	美國亞德諾半導體公司
主分類號：	G06F13/40	分類號：	G06F13/40;G06F13/42;H03L7/07
代理公司：	中國國際貿易促進委員會專利商標事務所 11038	代理人：	袁玥
地址：	美國馬***	國省代碼：	美國;US
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摘要：
搜索關鍵詞：	用于時鐘數據恢復裝置方法
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【說明書】：

提供了用于時鐘和數據恢復(CDR)的裝置和方法。在某些配置中，第一CDR電路捕獲來自第一通道上接收的第一輸入數據流的數據和邊沿樣本。數據和邊沿樣本用于產生主相位信號，它用于控制用于捕獲數據樣本的第一數據采樣時鐘信號的相位。另外，第一CDR電路基于主相位信號隨時間的變化產生主相位誤差信號，將主相位誤差信號至少轉發到第二CDR電路。第二CDR電路處理主相位誤差信號以產生用于控制用于捕獲來自第二通道上接收的第二輸入數據流的數據樣本的第二數據采樣時鐘信號的相位的從相位信號。

技術領域

本發明的實施例涉及電子設備，并且更具體地，涉及時鐘和數據恢復電路。

背景技術

時鐘和數據恢復(CDR)電路可以用于從高速串行數據流中恢復數據的各種應用。

例如，芯片到芯片的通信系統可以包括用于從第一集成電路(IC)或芯片到第二集成電路傳送數據的兩個或更多個串行通信鏈路或通道。另外，每個通道可以包括CDR電路，用于從在通道中接收到的輸入數據流中恢復數據。通過在兩個或更多個通道中并行傳送數據，相對于使用單一通道的結構，芯片到芯片通信系統可以表現出整體更高的數據速率。

發明內容

在一個方面，提供了時鐘和數據恢復(CDR)系統。CDR系統包括第一CDR電路和第二電路CDR。第一CDR電路配置以接收第一輸入數據流，并且基于跟蹤第一輸入數據流產生主相位信號。第一CDR電路還配置以基于主相位信號隨時間的變化產生主相位誤差信號。第二CDR電路配置以接收第二輸入數據流。第二CDR電路還配置以接收來自第一CDR電路的主相位誤差信號，并且基于主相位誤差信號產生第一從相位信號。第二CDR電路還配置以基于第一從相位信號跟蹤第二輸入數據流。

在另一個方面，提供了時鐘和數據恢復(CDR)的方法。該方法包括基于跟蹤第一輸入數據流，使用第一CDR電路，產生主相位信號，基于主相位信號隨時間的變化產生主相位誤差信號，基于主相位誤差信號產生第一從相位信號，并且基于第一從相位信號，使用第二CDR電路跟蹤第二輸入數據流。

在另一個方面，時鐘和數據恢復(CDR)系統包括第一CDR電路和第二電路CDR。第一CDR電路配置以接收第一輸入數據流，并且包括基于跟蹤第一輸入數據流，用于產生主相位信號的裝置和用于產生主相位誤差信號的裝置。第二CDR電路配置以接收第二輸入數據流和主相位誤差信號，并且包括基于第一從相位信號，用于跟蹤第二輸入數據流的裝置。

附圖說明

圖1是芯片到芯片通信系統的實施例的示意圖。

圖2A是主時鐘和數據恢復(CDR)電路的實施例的示意圖。

圖2B是從CDR電路的實施例的示意圖。

圖2C是可配置的主/從CDR電路的實施例的示意圖。

圖3是示出用于CDR電路的時序圖的一個實例的曲線圖。

圖4A是根據一個實施例，相位差編碼器的示意圖。

圖4B是根據一個實施例，相位差解碼器的示意圖。

圖5是根據一個實施例，部分CDR電路的示意圖。

圖6是根據一個實施例，時鐘與數據恢復方法的流程圖。

圖7是根據另一實施例，部分CDR電路的示意圖。

圖8是根據另一實施例，部分CDR電路的示意圖。