[發明專利]多路復用型顯示驅動電路有效
| 申請號: | 201610003066.5 | 申請日: | 2016-01-04 |
| 公開(公告)號: | CN105469765B | 公開(公告)日: | 2018-03-30 |
| 發明(設計)人: | 林建宏 | 申請(專利權)人: | 武漢華星光電技術有限公司 |
| 主分類號: | G09G3/36 | 分類號: | G09G3/36 |
| 代理公司: | 深圳市德力知識產權代理事務所44265 | 代理人: | 林才桂 |
| 地址: | 430070 湖北省武漢市*** | 國省代碼: | 湖北;42 |
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| 摘要: | |||
| 搜索關鍵詞: | 多路復用 顯示 驅動 電路 | ||
技術領域
本發明涉及顯示技術領域,尤其涉及一種多路復用型顯示驅動電路。
背景技術
在液晶顯示裝置(Liquid Crystal Display,LCD)與有機發光二極管顯示裝置(Organic Light Emitting Display,OLED)等平板顯示裝置中均包括多個陣列式排布的像素,每個像素通常包括紅、綠、藍三種顏色的子像素,每個子像素均受控于一條柵極線與一條數據線,柵極線用于控制子像素的開啟和關閉,數據線通過向子像素施加不同的數據電壓信號,使子像素顯示不同的灰階,從而實現全彩畫面的顯示。
隨著顯示技術的發展,人們對顯示裝置的顯示亮度、色彩還原性、畫面色彩的豐富性等顯示品質的追求越來越高,僅利用紅色、綠色和藍色三基色的顯示裝置,已不能滿足人們對顯示裝置的需求。隨之提出了一種由紅、綠、藍、白四種顏色組成的四色顯示裝置,在每個像素中增加一白色子像素,形成由紅色子像素R、綠色子像素G、藍色子像素B、及白色子像素W構成的RGBW像素結構。采用RGBW像素結構的顯示裝置在同樣的顯示畫面下,比采用RGB三色子像素結構的顯示裝置具有更大的像素間距(pixel pitch),且增加的白色子像素具有高穿透率,使得采用RGBW四色像素結構的顯示裝置具有高穿透率和高開口率的優點,受到消費者的追捧。
圖1所示為一種現有的采用RGBW四色像素結構的顯示裝置所使用的多路復用型顯示驅動電路,包括:多個驅動單元,每一驅動單元均包括:八條相互平行并依次排列的豎直的數據線D1-D8、至少兩條相互平行并依次排列的水平的掃描線Gn(n為正整數)、至少二行八列共十六個呈陣列式排布的子像素100、以及第一和第二多路復用模塊De10、De20;每一子像素100電性連接于該子像素100所在行對應的掃描線和該子像素100所在列對應的數據線;每一多路復用模塊均包括四個薄膜晶體管,該四個薄膜晶體管的柵極分別電性連接于第一分路控制信號Demux1、第二分路控制信號Demux2、第三分路控制信號Demux3、和第四分路控制信號Demux4,源極均電性連接同一數據信號,漏極分別電性連接一數據線。具體地,所述第一多路復用模塊De10包括:第一薄膜晶體管T10,所述第一薄膜晶體管T10的柵極電性連接于第一分路控制信號Demux1,源極電性連接于第一數據信號Data10,漏極電性連接于第一數據線D1;第二薄膜晶體管T20,所述第二薄膜晶體管T20的柵極電性連接于第二分路控制信號Demux2,源極電性連接于第一數據信號Data10,漏極電性連接于第六數據線D6;第三薄膜晶體管T30,所述第三薄膜晶體管T30的柵極電性連接于第三分路控制信號Demux3,源極電性連接于第一數據信號Data10,漏極電性連接于第七數據線D7;第四薄膜晶體管T40,所述第四薄膜晶體管T40的柵極電性連接于第四分路控制信號Demux4,源極電性連接于第一數據信號Data10,漏極電性連接于第四數據線D4;第二多路復用模塊De20包括:第五薄膜晶體管T50,所述第五薄膜晶體管T50的柵極電性連接于第一分路控制信號Demux1,源極電性連接于第二數據信號Data20,漏極電性連接于第五數據線D5;第六薄膜晶體管T60,所述第六薄膜晶體管T60的柵極電性連接于第二分路控制信號Demux2,源極電性連接于第二數據信號Data20,漏極電性連接于第二數據線D2;第七薄膜晶體管T70,所述第七薄膜晶體管T70的柵極電性連接于第三分路控制信號Demux3,源極電性連接于第二數據信號Data20,漏極電性連接于第三數據線D3;第八薄膜晶體管T80,所述第八薄膜晶體管T80的柵極電性連接于第四分路控制信號Demux4,源極電性連接于第二數據信號Data20,漏極電性連接于第八數據線D8。所述第一數據信號Data10為正極性,第二數據信號Data20為負極性,所述掃描線Gn接入掃描信號Gate,所述第一、第二、第三、和第四分路控制信號Demux1、Demux2、Demux3、Demux4的脈沖周期等于掃描信號Gate的脈沖周期的1/4。
請參閱圖2,隨著顯示裝置的解析度不斷提高,掃描信號Gate的脈沖周期也不斷縮短,從而不斷壓縮第一、第二、第三、和第四分路控制信號Demux1、Demux2、Demux3、Demux4的脈沖周期,每列子像素分配到的數據開關時間也隨之縮小,導致子像素的充電率不足,進入子像素的數據信號達不到位準電壓。
發明內容
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