[發明專利]用于縷程間通信的裝置和方法有效
| 申請號: | 201580077451.8 | 申請日: | 2015-03-27 |
| 公開(公告)號: | CN107408035B | 公開(公告)日: | 2021-11-09 |
| 發明(設計)人: | A·笛托弗;D·瑪司蘭尼克夫;S·施希洛夫;V·布洛夫;P·瑪特弗耶夫 | 申請(專利權)人: | 英特爾公司 |
| 主分類號: | G06F9/30 | 分類號: | G06F9/30;G06F9/38 |
| 代理公司: | 上海專利商標事務所有限公司 31100 | 代理人: | 何焜;錢慰民 |
| 地址: | 美國加利*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 用于 縷程間 通信 裝置 方法 | ||
1.一種處理器,包括:
一個或多個執行單元;
亂序OOO執行引擎;以及
前端,包括用于以下操作的電路:
接收有序指令的第一縷程中的第一指令和有序指令的第二縷程中的第二指令;以及
將所述第一指令和第二指令發送至所述OOO執行引擎;
其中所述OOO執行引擎包括用于以下操作的電路:
確定所述第一指令和所述第二指令對應于映射到物理寄存器的邏輯寄存器;
確定所述第一指令用于寫入所述邏輯寄存器并且用于通知要與所述第二縷程共享所述邏輯寄存器;
確定所述第二指令用于指示與所述第一指令的同步;以及
確定在所述第一指令之前處理了所述第二指令,
其中,所述OOO執行引擎進一步用于:響應于確定在所述第一指令之前處理了所述第二指令,停止在所述第二縷程中的所述第二指令之后的會訪問所述邏輯寄存器的指令的執行,直到所述第一指令被接收并執行。
2.如權利要求1所述的處理器,其特征在于,所述OOO執行引擎進一步用于:停止所述第二指令的執行,直到接收所述第一指令。
3.如權利要求1所述的處理器,其特征在于,所述OOO執行引擎進一步用于:通過設置預留站中的條目來停止一個或多個指令。
4.如權利要求1所述的處理器,其特征在于,所述OOO執行引擎進一步用于:利用包括預留站標識符的隊列跟蹤所述第一指令和第二指令是否已經到達了。
5.如權利要求1所述的處理器,其特征在于,所述OOO執行引擎進一步用于:使用包括寄存器重命名信息的隊列跟蹤所述第一指令和第二指令是否已經到達了。
6.如權利要求1所述的處理器,其特征在于,所述OOO執行引擎進一步包括用于以下操作的電路:
在所述第一指令或第二指令到達之后將用于所述物理寄存器的寄存器重命名信息添加到隊列;以及
分配跟蹤信息以指示所述第一縷程在所述第二縷程處理所述第二指令之前還是之后處理所述第一指令。
7.如權利要求1所述的處理器,其特征在于,所述前端進一步包括用于以下操作的電路:添加一個或多個指示符以指示在所述第一指令和所述第二指令中對所述邏輯寄存器的使用會被映射到相同的所述物理寄存器。
8.如權利要求1所述的處理器,其特征在于,所述第一指令包括用于標識所述邏輯寄存器的第一標簽,并且所述第二指令包括用于標識所述邏輯寄存器的第二標簽。
9.如權利要求1所述的處理器,其特征在于,進一步包括一個或多個執行單元,用于執行所述第一和第二指令。
10.一種用于指令處理的方法,包括在處理器內:
接收有序指令的第一縷程中的第一指令;
接收有序指令的第二縷程中的第二指令;
確定所述第一指令和所述第二指令引用映射到物理寄存器的邏輯寄存器;
確定所述第一指令用于寫入所述邏輯寄存器并且用于通知要與所述第二縷程共享所述邏輯寄存器;
確定所述第二指令用于指示與所述第一指令的同步;以及
確定在所述第一指令之前處理了所述第二指令,
其中,所述方法進一步包括:響應于確定在所述第一指令之前處理了所述第二指令,停止在所述第二縷程中的所述第二指令之后的會訪問所述邏輯寄存器的指令的執行,直到所述第一指令被接收并執行。
11.如權利要求10所述的方法,其特征在于,進一步包括通過設置預留站中的條目來指示在所述第二縷程中的所述第二指令之后的指令要停止。
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