[發明專利]具體用于鐵路運載工具的氣動制動安裝的電動氣動組件有效
| 申請號: | 201580061610.5 | 申請日: | 2015-11-12 |
| 公開(公告)號: | CN107107897B | 公開(公告)日: | 2019-08-09 |
| 發明(設計)人: | 羅伯托·蒂奧內;安德烈亞·卡瓦齊;安杰洛·格拉索 | 申請(專利權)人: | 法伊韋利傳送器意大利有限公司 |
| 主分類號: | B60T13/66 | 分類號: | B60T13/66;B60T13/68 |
| 代理公司: | 北京康信知識產權代理有限責任公司 11240 | 代理人: | 梁麗超;田喜慶 |
| 地址: | 意大利*** | 國省代碼: | 意大利;IT |
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| 摘要: | |||
| 搜索關鍵詞: | 電子開關 螺線管 腔室 控制器件 供應閥 排氣閥 耦接 電子控制器件 接收輸入信號 邏輯控制信號 鐵路運載工具 彼此獨立 電動氣動 控制腔室 控制裝置 螺線管閥 氣動制動 預定方式 組件組件 壓力源 使能 電路 驅動 | ||
1.一種用于鐵路運載工具或火車的氣動制動安裝的電動氣動組件,包括:
主體,其中定義了腔室,
螺線管供應閥,適于將所述腔室選擇性地耦接到壓力源或大氣,
螺線管排氣或排放閥,適于允許并選擇性地阻止所述腔室連接到所述大氣;
所述螺線管供應閥和所述螺線管排氣或排放閥設置有相應的控制螺線管,相應的電子開關被耦接到所述控制螺線管上;以及
電子控制裝置,適于根據至少一個輸入信號的值,將邏輯控制信號提供給所述電子開關以便通過所述螺線管供應閥和所述螺線管排氣或排放閥控制在所述腔室中的壓力的值;
所述電動氣動組件的特性在于:
所述電子控制裝置包括彼此獨立的第一電子處理和控制器件和第二電子處理和控制器件,兩者彼此等效地接收所述至少一個輸入信號并被設計成執行用于控制在所述腔室中的壓力的策略;所述第一電子處理和控制器件和所述第二電子處理和控制器件各自通過相應的第一電子開關和第二電子開關被耦接到所述螺線管供應閥和螺線管排氣或排放閥的所述控制螺線管;
分別與所述第一電子處理和控制器件和所述第二電子處理和控制器件相關聯的所述第一電子開關和所述第二電子開關以預定的方式彼此耦接,以便一起形成被設計為以如下方式驅動所述螺線管供應閥和所述螺線管排氣或排放閥的控制螺線管的使能邏輯電路:
當由所述第一電子處理和控制器件和所述第二電子處理和控制器件提供的邏輯控制信號彼此沖突時,被致動的邏輯控制信號是由傾向于在所述腔室中產生其值與由于其他電子處理和控制器件提供的邏輯控制信號產生的值相比符合預定的關系的壓力的電子處理和控制器件提供的那些信號。
2.根據權利要求1所述的電動氣動組件,其中,所述使能邏輯電路被設計成以如下方式驅動所述螺線管供應閥和所述螺線管排氣或排放閥的所述控制螺線管:
當由所述第一電子處理和控制器件和所述第二電子處理和控制器件提供的邏輯控制信號彼此沖突時,被致動的邏輯控制信號是由傾向于在所述腔室中產生較大的壓力的電子處理和控制器件提供的那些信號。
3.根據權利要求1所述的電動氣動組件,其中,所述使能邏輯電路被設計成以如下方式驅動所述螺線管供應閥和所述螺線管排氣或排放閥的所述控制螺線管:
當由所述第一電子處理和控制器件和所述第二電子處理和控制器件提供的邏輯控制信號彼此沖突時,被致動的邏輯控制信號是由傾向于在所述腔室中產生較低的壓力的電子處理和控制器件提供的那些信號。
4.根據權利要求2所述的電動氣動組件,其中,所述螺線管供應閥和所述螺線管排氣或排放閥分別是常閉和常開的三通閥、兩位置閥并且是串聯連接的;所述螺線管供應閥連接在所述壓力源和所述腔室之間,所述螺線管排氣或排放閥連接至所述螺線管供應閥的輸出端且連接至所述腔室。
5.根據權利要求4所述的電動氣動組件,其中,所述螺線管供應閥和所述螺線管排氣或排放閥中的每個的控制螺線管連接到彼此電連接的所述第一電子開關和所述第二電子開關,以形成具有分別連接到所述第一電子處理和控制器件以及所述第二電子處理和控制器件的兩個輸入端的OR型邏輯電路。
6.根據權利要求1至3中任一項所述的電動氣動組件,其中,所述螺線管供應閥和所述螺線管排氣或排放閥分別是常閉的三通閥、兩位置閥并且是串聯連接的;所述螺線管供應閥連接在所述壓力源和所述腔室之間,所述螺線管排氣或排放閥連接至所述螺線管供應閥的輸出端且連接至所述腔室。
7.根據權利要求3所述的電動氣動組件,其中:
所述螺線管供應閥的所述控制螺線管連接到彼此電連接的所述第一電子開關和所述第二電子開關,以形成具有分別連接到所述第一電子處理和控制器件以及所述第二電子處理和控制器件的兩個輸入端的AND型邏輯電路,并且其中:
所述螺線管排氣或排放閥的控制螺線管連接到彼此電連接的所述第一電子開關和所述第二電子開關,以形成具有分別連接到所述第一電子處理和控制器件以及所述第二電子處理和控制器件的兩個輸入端的OR型邏輯電路。
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