[實用新型]總線型運動控制器有效
| 申請號： | 201520083570.1 | 申請日： | 2015-02-05 |
| 公開（公告）號： | CN204480008U | 公開（公告）日： | 2015-07-15 |
| 發明（設計）人： | 耿慶華;馬爭先;陳佳溪;邊慧杰 | 申請（專利權）人： | 珠海格力電器股份有限公司 |
| 主分類號： | G05B19/414 | 分類號： | G05B19/414 |
| 代理公司： | 廣州華進聯合專利商標代理有限公司 44224 | 代理人： | 鄭小粵;李雙皓 |
| 地址： | 519070*** | 國省代碼： | 廣東;44 |
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| 摘要： | |||
| 搜索關鍵詞： | 線型 運動 控制器 | ||
1.一種總線型運動控制器，其特征在于，包括FPGA模塊(110)、DSP模塊(120)和以太網模塊(130)；
所述FPGA模塊(110)電連接在所述DSP模塊(120)和所述以太網模塊(130)之間，與所述DSP模塊(120)進行數據交互；
所述FPGA模塊(110)通過所述以太網模塊(130)，采用TCP/IP協議與上位機通信，接收并傳輸所述上位機發送的數據至所述DSP模塊(120)；
所述DSP模塊(120)根據所述數據和運動控制功能庫進行分析計算，獲取并反饋控制命令至所述FPGA模塊(110)；
所述FPGA模塊(110)通過所述以太網模塊(130)，采用POWERLINK協議與伺服驅動器通信，傳輸所述控制命令至所述伺服驅動器。
2.根據權利要求1所述的總線型運動控制器，其特征在于，所述FPGA模塊(110)的型號為EP4CE30；所述DSP模塊(120)的型號為ADSP21489。
3.根據權利要求1所述的總線型運動控制器，其特征在于，還包括第一存儲模塊(140)和第一緩存模塊(150)；
所述第一存儲模塊(140)和所述第一緩存模塊(150)均與所述FPGA模塊(110)通信連接；
所述第一存儲模塊(140)，用于存儲所述FPGA模塊(110)執行的應用程序；
所述第一緩存模塊(150)，用于緩存所述FPGA模塊(110)接收到的所述數據。
4.根據權利要求1所述的總線型運動控制器，其特征在于，還包括第二存儲模塊(160)和第二緩存模塊(170)；
所述第二存儲模塊(160)和第二緩存模塊(170)均與所述DSP模塊(120)通信連接；
所述第二存儲模塊(160)用于存儲所述運動控制功能庫；
所述第二緩存模塊(170)，用于存儲所述DSP模塊(120)接收到的所述數據。
5.根據權利要求3所述的總線型運動控制器，其特征在于，所述第一存儲模塊(140)為第一FLASH芯片；所述第一緩存模塊(150)為DDR2芯片。
6.根據權利要求4所述的總線型運動控制器，其特征在于，所述第二存儲模塊(160)為第二FLASH芯片；所述第二緩存模塊(170)為SDRAM芯片。
7.根據權利要求1所述的總線型運動控制器，其特征在于，所述以太網模塊(130)包括第一以太網單元(131)和第二以太網單元(132)；
所述第一以太網單元(131)電連接在所述FPGA模塊(110)與所述上位機之間；
所述第二以太網單元(132)電連接在所述FPGA模塊(110)與所述伺服驅動器之間。
8.根據權利要求4所述的總線型運動控制器，其特征在于，所述FPGA模塊(110)、所述第二存儲模塊(160)和所述第二緩存模塊(170)均通過所述DSP模塊(120)外設的AMI接口與所述DSP模塊(120)通訊連接。
9.根據權利要求1所述的總線型運動控制器，其特征在于，所述DSP模塊(120)外設有高速串口接口(121)和串口接口(122)；
所述DSP模塊(120)與所述FPGA模塊(110)通過所述高速串口接口(121)和串口接口(122)進行數據交互。
10.根據權利要求9所述的總線型運動控制器，其特征在于，所述DSP模塊(120)還外設有定時器接口(123)和狀態指示接口(124)；
所述定時器接口(123)和所述狀態指示接口(124)均與所述FPGA模塊(110)電連接。
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