[發明專利]一種改善差分走線阻抗失配的設計方法在審
| 申請號： | 201510366005.0 | 申請日： | 2015-06-29 |
| 公開（公告）號： | CN104994687A | 公開（公告）日： | 2015-10-21 |
| 發明（設計）人： | 孫龍;武寧 | 申請（專利權）人： | 浪潮電子信息產業股份有限公司 |
| 主分類號： | H05K3/00 | 分類號： | H05K3/00 |
| 代理公司： | 濟南信達專利事務所有限公司 37100 | 代理人： | 姜明 |
| 地址： | 250101 山東*** | 國省代碼： | 山東;37 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 改善 差分走線 阻抗 失配 設計 方法 | ||
【權利要求書】：
1.一種改善差分走線阻抗失配的設計方法，其特征在于，
具體實施步驟如下：
1）、上件PCB板進行阻抗實測，看是否超出阻抗公差；
2）、上件PCB板進行信號眼圖測試，觀察其信號Jitter是否過大；
3）、在差分線之間并接可調電阻；
4）、再次進行信號眼圖測試，調節電阻值直至Jitter抖動滿足信號要求。
2.根據權利要求1所述的方法，其特征在于，
利用電阻并聯原理，即差分線并接電阻與差分線特性阻抗進行并接，其等效信號傳播路徑阻抗會整體偏低；調節并接電阻值，使其高阻抗降低到目標值管控范圍之內。
3.根據權利要求2所述的方法，其特征在于，
進行rework調試，然后再測試阻抗超標的SAS通道，使阻抗值滿足目標阻抗管控范圍之內，同時，再次進行SAS眼圖的測試，觀察其信號Jitter的改善情況。
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