[實用新型]一種低寫功耗的兩端口靜態隨機存儲器有效
| 申請號： | 201420151869.1 | 申請日： | 2014-03-31 |
| 公開（公告）號： | CN203799667U | 公開（公告）日： | 2014-08-27 |
| 發明（設計）人： | 熊保玉;拜福君 | 申請（專利權）人： | 西安華芯半導體有限公司 |
| 主分類號： | G11C11/413 | 分類號： | G11C11/413 |
| 代理公司： | 西安西交通盛知識產權代理有限責任公司 61217 | 代理人： | 王萌 |
| 地址： | 710055 陜西省西安*** | 國省代碼： | 陜西;61 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 功耗 端口 靜態 隨機 存儲器 | ||
1.一種低寫功耗的兩端口靜態隨機存儲器，其特征在于，包括譯碼器、存儲陣列、控制電路與預譯碼器、位線均衡器、靜態寫驅動器和寫預判比較器；
譯碼器通過多條字線（WL）連接存儲陣列，譯碼器還通過多條預譯碼器輸出（PRE_DEC）連接控制電路與預譯碼器；
存儲陣列通過多條寫位線（WBL）連接位線均衡器、靜態寫驅動器和寫預判比較器；
控制電路與預譯碼器通過本地時鐘（LCLK）和寫使能（WEN_INT）連接位線均衡器、靜態寫驅動器和寫預判比較器。
2.根據權利要求1所述的一種低寫功耗的兩端口靜態隨機存儲器，其特征在于，寫位線均衡器、靜態寫驅動器和寫預判比較器包括反相器鏈和與非門（304）組成的脈沖產生電路、或門（305）、第一鎖存器（306）、異或門（307）、D觸發器（308）、第二鎖存器（309）、反相器（310）、第一三態反相器（311）、第二三態反相器（312）、寫位線電容（CWBL）、寫位線反電容（CWBLB）和PMOS晶體管（315）；
本地時鐘（LCLK）連接與非門（304）的第二輸入端和反相器鏈的輸入端，寫使能（WEN_INT）連接與非門（304）的第一輸入端，反相器鏈的輸出端連接與非門（304）的第三輸入端；與非門（304）的輸出端連接或門（305）的第一輸入端；
時鐘（CLK）連接第一鎖存器（306）的使能端EN、D觸發器（308）的時鐘端CK和第二鎖存器（309）的使能端EN；寫入數據（D）連接第二鎖存器（309）的數據輸入端D；第二鎖存器（309）的數據輸出端Q連接異或門（307）的第二輸入端、D觸發器（308）的數據輸入端D、反相器（310）的輸入端和第二三態反相器（312）的輸入端；
D觸發器（308）的輸出端Q連接異或門（307）的第一輸入端，異或門（307）的輸出端連接第一鎖存器（306）的數據輸入端D；第一鎖存器（306）的輸出端Q連接或門（305）的第二輸入端，或門（305）的輸出端連接PMOS晶體管（315）的柵極；
反相器（310）的輸出端連接第一三態反相器（311）的輸入端，第一三態反相器（311）的輸出端連接寫位線電容（CWBL）一端和PMOS晶體管（315）的漏極，寫位線電容（CWBL）的另一端接VSS；第二三態反相器（312）的輸出端連接寫位線反電容（CWBLB）一端和PMOS晶體管（315）的源極；寫位線反電容（CWBLB）的另一端接VSS。
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