[發明專利]一種防止總線死鎖的裝置及方法有效
| 申請號: | 201410558296.9 | 申請日: | 2014-10-20 |
| 公開(公告)號: | CN105589821B | 公開(公告)日: | 2019-03-12 |
| 發明(設計)人: | 蔣建平 | 申請(專利權)人: | 深圳市中興微電子技術有限公司 |
| 主分類號: | G06F13/36 | 分類號: | G06F13/36 |
| 代理公司: | 北京派特恩知識產權代理有限公司 11270 | 代理人: | 張穎玲;蔣雅潔 |
| 地址: | 518085 廣*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 防止 總線 死鎖 裝置 方法 | ||
1.一種防止總線死鎖的裝置,其特征在于,所述裝置包括:
外設延時單元,用于監測總線和外設之間的總線狀態,得到第一總線狀態信號發送給狀態監控單元,并根據收到的復位控制指令對總線和外設之間的第一握手信號進行復位操作;
處理器延時單元,用于監測總線和處理器之間的總線狀態,得到第二總線狀態信號發送給狀態監控單元,并根據收到的復位控制指令對總線和處理器之間的第二握手信號進行復位操作;
狀態監控單元,用于對所述第一總線狀態信號內的數據信號進行計時,得到第一計時時間,當所述第一計時時間超過第一設定時間時,向所述外設延時單元發送第一復位控制指令;所述第一復位控制指令用于使所述外設延時單元對所述第一握手信號進行復位操作;和/或對所述第二總線狀態信號內的數據信號進行計時,得到第二計時時間,當所述第二計時時間超過第二設定時間時,向所述處理器延時單元發送第二復位控制指令;所述第二復位控制指令用于使所述處理器延時單元對所述第二握手信號進行復位操作。
2.根據權利要求1所述的裝置,其特征在于,所述裝置包括:
總線配置單元,用于向所述外設延時單元發送第一配置信號,所述第一配置信號用于使能所述外設延時單元對所述第一握手信號的復位操作;和/或向所述處理器延時單元發送第二配置信號;所述第二配置信號用于使能所述處理器延時單元對所述第二握手信號的復位操作。
3.根據權利要求1或2所述的裝置,其特征在于,所述外設延時單元包括:
第一總線狀態監控模塊,用于監測總線和外設之間的第一總線狀態信號,并將所述第一總線狀態信號發送給所述狀態監控單元;
第一復位模塊,用于根據所述狀態監控單元發來的所述第一復位控制指令對總線和外設之間的所述第一握手信號進行延時,并對所述第一握手信號進行復位操作。
4.根據權利要求1或2所述的裝置,其特征在于,所述處理器延時單元包括:
第二總線狀態監控模塊,用于監控總線和處理器之間的第二總線狀態信號,并將所述第二總線狀態信號發送給所述狀態監控單元;
第二復位模塊,用于根據所述狀態監控單元發來的所述第二復位控制指令對總線和處理器之間的所述第二握手信號進行延時,并對所述第二握手信號進行復位操作。
5.根據權利要求1或2所述的裝置,其特征在于,所述狀態監控單元包括:
看門狗模塊,用于對所述外設延時單元監測到的第一總線狀態信號內的數據信號進行計時,得到第一計時時間;和/或對處理器延時單元監測到的第二總線狀態信號內的數據信號進行計時,得到第二計時時間;
指令發送模塊,用于在第一計時時間超過第一設定時間時和/或第二計時時間超過第二設定時間時,向所述外設延時單元發送第一復位控制指令;和/或向所述處理器延時單元發送第二復位控制指令;所述第一設定時間和第二設定時間小于總線死鎖時間。
6.根據權利要求5所述的裝置,其特征在于,所述狀態監控單元還包括:
中斷處理模塊,用于接收所述指令發送模塊發來的第三復位控制指令,根據所述第三復位控制指令禁止所述處理器對總線進行指令操作;并在經過第三設定時間后允許所述處理器對總線進行指令操作。
7.一種防止芯片總線死鎖的方法,其特征在于,所述方法包括:
監測總線和外設之間的總線狀態,得到第一總線狀態信號;
監測總線和處理器之間的總線狀態,得到第二總線狀態信號;
對所述第一總線狀態信號內的數據信號進行計時,得到第一計時時間;當所述第一計時時間超過第一設定時間時,發送第一復位控制指令;和/或對所述第二總線狀態信號內的數據信號進行計時,得到第二計時時間;當所述第二計時時間超過第二設定時間時,發送第二復位控制指令;
根據所述第一復位控制指令對第一握手信號進行復位操作;和/或根據所述第二復位控制指令對第二握手信號進行復位操作。
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