[發(fā)明專利]一種調(diào)試FPGA預(yù)加重均衡的方法在審
| 申請?zhí)枺?/td> | 201410225340.4 | 申請日： | 2014-05-23 |
| 公開（公告）號： | CN103970699A | 公開（公告）日： | 2014-08-06 |
| 發(fā)明（設(shè)計）人： | 王素華 | 申請（專利權(quán)）人： | 浪潮電子信息產(chǎn)業(yè)股份有限公司 |
| 主分類號： | G06F13/38 | 分類號： | G06F13/38 |
| 代理公司： | 濟南信達專利事務(wù)所有限公司 37100 | 代理人： | 張靖 |
| 地址： | 250014 山東*** | 國省代碼： | 山東;37 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 調(diào)試 fpga 加重 均衡 方法 | ||
1.一種調(diào)試FPGA預(yù)加重均衡的方法，其特征在于：在研發(fā)設(shè)計FPGA階段，設(shè)計FPGA驗證板，板內(nèi)處理器到FPGA之間，采用新型高速互聯(lián)總線，處理器板同F(xiàn)PGA板采用正交方式連接，板邊設(shè)置互聯(lián)傳輸通道的S參數(shù)測試接口，獲得真實的互聯(lián)參數(shù)，通過網(wǎng)絡(luò)分析儀測得通道的S參數(shù)，通過誤碼率分析儀對此通道S參數(shù)進行預(yù)加重的預(yù)測，遍歷出針對此參數(shù)的最佳預(yù)加重值，固定一端的預(yù)加重，再確定接收端的CTLE值。
2.根據(jù)權(quán)利要求1所述的一種調(diào)試FPGA預(yù)加重均衡的方法，其特征在于：所述互聯(lián)總線是一種新型的高速串行總線，總線傳輸速率為8Gbps。
3.根據(jù)權(quán)利要求1所述的一種調(diào)試FPGA預(yù)加重均衡的方法，其特征在于：處理器同F(xiàn)PGA之間通過跨板互聯(lián)，PCB傳輸長度為15inch,路徑經(jīng)過一個高速正交連接器以及兩個BGA下的過孔，總傳輸損耗約為8.5dB。
4.根據(jù)權(quán)利要求1所述的一種調(diào)試FPGA預(yù)加重均衡的方法，其特征在于：在設(shè)計FPGA板時仿照互聯(lián)之間真實的走線情況在板邊設(shè)計測試鏈路。
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