[發(fā)明專利]用于移相全橋同步整流電路的驅(qū)動電路及其控制方法有效
| 申請?zhí)枺?/td> | 201410135028.6 | 申請日: | 2014-07-01 |
| 公開(公告)號: | CN104167940B | 公開(公告)日: | 2017-02-15 |
| 發(fā)明(設(shè)計)人: | 杜貴平;李治泳 | 申請(專利權(quán))人: | 華南理工大學(xué) |
| 主分類號: | H02M7/217 | 分類號: | H02M7/217;H02M3/335 |
| 代理公司: | 廣州粵高專利商標(biāo)代理有限公司44102 | 代理人: | 何淑珍 |
| 地址: | 511400 廣東省廣州市*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 用于 移相全橋 同步 整流 電路 驅(qū)動 及其 控制 方法 | ||
1.用于移相全橋同步整流電路的驅(qū)動電路,其特征在于,該電路包括邏輯控制電路和DSP控制器,所述DSP控制器產(chǎn)生用于移相全橋同步整流電路中初級側(cè)一組斜對角開關(guān)管的第一驅(qū)動信號(PWMA)以及第二驅(qū)動信號(PWMB)和用于邏輯控制電路的時鐘脈沖信號(CLK),所述的邏輯控制電路輸出用于驅(qū)動移相全橋同步整流電路中次級側(cè)同步整流管的驅(qū)動信號(SQ)。
2.根據(jù)權(quán)利要求1所述的用于移相全橋同步整流電路的驅(qū)動電路,其特征在于邏輯控制電路包含一個與門(AND1)、兩個非門(NOT1和NOT2)、一個或門(OR1)、一個JK觸發(fā)器(D1);第一驅(qū)動信號(PWMA)和與門(AND1)的第一輸入端相連,第一非門(NOT1)的輸出端和與門(AND1)的第二輸入端相連,第二驅(qū)動信號(PWMB)和非門(NOT1)輸入端相連,第一驅(qū)動信號(PWMA)和或門(OR1)的第一輸入端相連,第二驅(qū)動信號(PWMB)和或門(OR1)的第二輸入端相連,或門(OR1)的輸出端和第二非門(NOT2)的輸入端相連,與門(AND1)的輸出端和觸發(fā)器(D1)的第一輸入端(J)相連,第二非門(NOT2)的輸出端與觸發(fā)器(D1)的第二輸入端(K)相連,DSP控制器的時鐘脈沖信號輸出端與觸發(fā)器(D1)的時鐘輸入端相連。
3.根據(jù)權(quán)利要求1所述的用于移相全橋同步整流電路的驅(qū)動電路,其特征在于第一驅(qū)動信號(PWMA)和第二驅(qū)動信號(PWMB)具有相同的頻率?,并且兩者之間具有可調(diào)的移相角α。
4.根據(jù)權(quán)利要求1所述的用于移相全橋同步整流電路的驅(qū)動電路,其特征在于當(dāng)?shù)谝或?qū)動信號(PWMA)以及第二驅(qū)動信號(PWMB)同時為低電平時,驅(qū)動信號(SQ)在下一個時鐘信號的下降沿變?yōu)榈碗娖剑駝t均為高電平。
5.根據(jù)權(quán)利要求1所述的用于移相全橋同步整流電路的驅(qū)動電路,其特征在于時鐘脈沖信號(CLK)的頻率為(2N-1)?/(1+2α)倍,N取能整除1000的任意正整數(shù)。
6.根據(jù)權(quán)利要求1所述的用于移相全橋同步整流電路的驅(qū)動電路,其特征在于DSP處理器采用德州儀器公司TMS320C2000系列DSP控制器。
7.用于權(quán)利要求1~6任一項所述的用于移相全橋同步整流電路的驅(qū)動電路的控制方法是:在移相全橋同步整流電路中初級側(cè)一組斜對角開關(guān)管的第一驅(qū)動信號(PWMA)以及第二驅(qū)動信號(PWMB)中,只要有一個信號為高電平,則在下一個時鐘脈沖信號的下降沿來臨時,邏輯控制電路輸出信號(SQ)為高電平;當(dāng)移相全橋同步整流電路中初級側(cè)一組斜對角開關(guān)管的第一驅(qū)動信號(PWMA)以及第二驅(qū)動信號(PWMB)同時為低電平時,則在下一個時鐘脈沖信號的下降沿來臨時,邏輯控制電路輸出信號(SQ)為低電平。
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