[發明專利]一種首尾次序耦合環式陣列集成電感無效
| 申請號： | 201310529060.8 | 申請日： | 2013-11-01 |
| 公開（公告）號： | CN103578722A | 公開（公告）日： | 2014-02-12 |
| 發明（設計）人： | 李洪珠;榮德生;丁冠西 | 申請（專利權）人： | 遼寧工程技術大學 |
| 主分類號： | H01F37/00 | 分類號： | H01F37/00;H01F27/24;H01F27/26 |
| 代理公司： | 暫無信息 | 代理人： | 暫無信息 |
| 地址： | 123000 遼寧*** | 國省代碼： | 遼寧;21 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 首尾 次序 耦合 陣列 集成 電感 | ||
【權利要求書】：
1.一種首尾次序耦合環式陣列集成電感，其特征在于由2n個陣列化磁芯單元構成，其中n個磁芯實現n相電感的耦合，位于n邊形的頂點位置，另外n個磁芯實現每相耦合電感漏感的調節，位于n邊形的邊線中間位置。
2.根據權利1要求所述首尾次序耦合環式陣列集成電感，陣列化磁芯形狀為包括環形磁芯與平面矩形磁芯的各種磁芯，繞組為包括PCB繞組的各種繞組。
3.根據權利1要求所述首尾次序耦合環式陣列集成電感，各磁芯位置可以根據需要調整，不完全限于多邊形頂點與邊的位置。
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