[發(fā)明專利]鎖存電路、非易失性存儲器件及集成電路有效
| 申請?zhí)枺?/td> | 201310143161.1 | 申請日： | 2013-04-23 |
| 公開（公告）號： | CN103377705B | 公開（公告）日： | 2018-03-09 |
| 發(fā)明（設計）人： | 崔成旲 | 申請（專利權）人： | 愛思開海力士有限公司 |
| 主分類號： | G11C16/06 | 分類號： | G11C16/06 |
| 代理公司： | 北京弘權知識產(chǎn)權代理事務所(普通合伙)11363 | 代理人： | 許偉群,俞波 |
| 地址： | 韓國*** | 國省代碼： | 暫無信息 |
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| 摘要： | |||
| 搜索關鍵詞： | 電路 非易失性存儲器 集成電路 | ||
1.一種鎖存電路，包含：
多個鎖存器，其被配置成響應于供應至上拉供電節(jié)點及下拉供電節(jié)點的電力而操作；
延遲單元，其被配置成通過延遲第一重設信號及第二重設信號來產(chǎn)生第一延遲的重設信號及第二延遲的重設信號；
供電單元，其被配置成響應于激活的第一重設信號或激活的第二重設信號而將同樣的電力供應至所述上拉供電節(jié)點及所述下拉供電節(jié)點；
第一重設單元，其被配置成響應于所述第一延遲的重設信號而將多個鎖存器重設至第一電平；及
第二重設單元，其被配置成響應于所述第二延遲的重設信號而將所述多個鎖存器重設至第二電平。
2.如權利要求1所述的鎖存電路，其中所述供電單元響應于去激活的第一重設信號及去激活的第二重設信號而將上拉電壓供應至所述上拉供電節(jié)點、且將下拉電壓供應至所述下拉供電節(jié)點。
3.如權利要求2所述的鎖存電路，其中所述供電單元響應于所述激活的第一重設信號或所述激活的第二重設信號而將介于所述上拉電壓與所述下拉電壓之間的預設電平的電壓供應至所述上拉供電節(jié)點及所述下拉供電節(jié)點。
4.如權利要求2所述的鎖存電路，其中所述供電單元響應于所述激活的第一重設信號或所述激活的第二重設信號而將所述下拉電壓供應至所述上拉供電節(jié)點及所述下拉供電節(jié)點。
5.如權利要求2所述的鎖存電路，其中所述供電單元響應于所述激活的第一重設信號或所述激活的第二重設信號而耦合所述上拉供電節(jié)點與所述下拉供電節(jié)點。
6.如權利要求5所述的鎖存電路，其中：
當所述第一重設信號或所述第二重設信號被激活時，所述下拉供電節(jié)點接地，所述供電單元耦合所述上拉供電節(jié)點與所述下拉供電節(jié)點。
7.如權利要求1所述的鎖存電路，其中：
所述第一延遲的重設信號的激活時段與所述第一重設信號的激活時段彼此至少部分地重疊，且
所述第二延遲的重設信號的激活時段與所述第二重設信號的激活時段彼此至少部分地重疊。
8.一種非易失性存儲器件，包含：
多個存儲器單元；
多個頁緩沖器，其被配置成存取儲存于各自的存儲器單元中的數(shù)據(jù)、且各自包含一個或多個鎖存器，所述一個或多個鎖存器響應于供應至上拉供電節(jié)點及下拉供電節(jié)點的電力而操作；
延遲單元，其被配置成通過延遲第一重設信號及第二重設信號來產(chǎn)生第一延遲的重設信號及第二延遲的重設信號；
供電單元，其被配置成響應于激活的第一重設信號或激活的第二重設信號而將同樣的電力供應至所述上拉供電節(jié)點及所述下拉供電節(jié)點；及
重設單元，其被配置成響應于所述第一延遲的重設信號而將所述一個或多個鎖存器重設至第一電平，且響應于所述第二延遲的重設信號而將所述一個或多個鎖存器重設至第二電平。
9.如權利要求8所述的非易失性存儲器件，其中所述供電單元響應于去激活的第一重設信號及去激活的第二重設信號而將上拉電壓供應至所述上拉供電節(jié)點、且將下拉電壓供應至所述下拉供電節(jié)點。
10.如權利要求9所述的非易失性存儲器件，其中所述供電單元響應于所述激活的第一重設信號或所述激活的第二重設信號而將介于所述上拉電壓與所述下拉電壓之間的預設電平的電壓供應至所述上拉供電節(jié)點及所述下拉供電節(jié)點。
11.如權利要求9所述的非易失性存儲器件，其中所述供電單元響應于所述激活的第一重設信號或所述激活的第二重設信號而將所述下拉電壓供應至所述上拉供電節(jié)點及所述下拉供電節(jié)點。
12.如權利要求9所述的非易失性存儲器件，其中所述供電單元響應于所述激活的第一重設信號或所述激活的第二重設信號而耦合所述上拉供電節(jié)點與所述下拉供電節(jié)點。
13.如權利要求12所述的非易失性存儲器件，其中：當所述第一重設信號或所述第二重設信號被激活時，所述下拉供電節(jié)點接地，所述供電單元耦合所述上拉供電節(jié)點與所述下拉供電節(jié)點。
14.如權利要求8所述的非易失性存儲器件，其中：所述第一延遲的重設信號的激活時段與所述第一重設信號的激活時段彼此至少部分地重疊，且所述第二延遲的重設信號的激活時段與所述第二重設信號的激活時段彼此至少部分地重疊。
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