[發明專利]一種深硅通孔刻蝕方法有效
| 申請號: | 201210445649.5 | 申請日: | 2012-11-08 |
| 公開(公告)號: | CN103811408A | 公開(公告)日: | 2014-05-21 |
| 發明(設計)人: | 黃秋平;許頌臨 | 申請(專利權)人: | 中微半導體設備(上海)有限公司 |
| 主分類號: | H01L21/768 | 分類號: | H01L21/768;H01L21/3065 |
| 代理公司: | 上海智信專利代理有限公司 31002 | 代理人: | 王潔 |
| 地址: | 201201 上海市浦東新*** | 國省代碼: | 上海;31 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 深硅通孔 刻蝕 方法 | ||
1.一種深孔硅刻蝕方法用于刻蝕硅基片,所述硅基片上包括一圖形化的掩膜層,所述刻蝕方法包括
第一刻蝕階段,以所述圖形化的掩膜層為掩膜刻蝕硅基片形成第一深度(H1)的開口,所述開口兩側側壁的間距從頂部向下逐漸減小,且在第一深度處具有第一側壁間距(D21),
在第一刻蝕階段結束后進入主刻蝕階段,所述主刻蝕階段包括交替進行的刻蝕和沉積步驟,在刻蝕步驟中通入刻蝕氣體對硅基片進行刻蝕,在沉積步驟中通入氟碳化合物氣體對刻蝕形成的開口側壁進行保護,所述主刻蝕階段,所述開口從所述第一深度刻蝕到第二深度,同時使所述第一深度處的第一側壁間距增大到第二間距(D22)。
2.如權利要求1所述的刻蝕方法,其特征在于,所述圖形化的掩膜層在第一刻蝕階段具有第一關鍵尺寸,在完成主刻蝕階段后所述掩膜層具有第二關鍵尺寸,所述第二關鍵尺寸大于所述第一關鍵尺寸。
3.如權利要求1所述的刻蝕方法,其特征在于,所述第一刻蝕階段的刻蝕氣體包括SF6、C4F8、O2。
4.如權利要求1所述的刻蝕方法,其特征在于,所述的主刻蝕階段刻蝕的第二深度大于30um。
5.如權利要求1所述的刻蝕方法,其特征在于,所述主刻蝕階段中的刻蝕步驟通入的刻蝕氣體選自SF6和NF3之一。
6.如權利要求2所述的刻蝕方法,其特征在于,所述第一刻蝕階段形成的第一深度開口上端側壁間的間距(D20)大于所述第一關鍵尺寸(D1)1um以上。
7.如權利要求6所述的刻蝕方法,其特征在于,所述第一刻蝕階段形成的第一深度開口上端側壁間的間距大于所述第一關鍵尺寸,且差值大于1um小于6um。
8.如權利要求2所述的刻蝕方法,其特征在于所述第一關鍵尺寸選自4-6um,第二關鍵尺寸選自7-8um。
9.如權利要求1所述的刻蝕方法,其特征在于,所述第一深度開口的下段側壁間距小于1.1倍的開口上端側壁間的間距。
10.如權利要求1所述的刻蝕方法,其特征在于,所述第一深度大于2um。
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H01L 半導體器件;其他類目中不包括的電固體器件
H01L21-00 專門適用于制造或處理半導體或固體器件或其部件的方法或設備
H01L21-02 .半導體器件或其部件的制造或處理
H01L21-64 .非專門適用于包含在H01L 31/00至H01L 51/00各組的單個器件所使用的除半導體器件之外的固體器件或其部件的制造或處理
H01L21-66 .在制造或處理過程中的測試或測量
H01L21-67 .專門適用于在制造或處理過程中處理半導體或電固體器件的裝置;專門適合于在半導體或電固體器件或部件的制造或處理過程中處理晶片的裝置
H01L21-70 .由在一共用基片內或其上形成的多個固態組件或集成電路組成的器件或其部件的制造或處理;集成電路器件或其特殊部件的制造





