[發明專利]一種多處理器設備及其程序運行方法無效
| 申請號: | 201210175587.0 | 申請日: | 2012-05-31 |
| 公開(公告)號: | CN102722467A | 公開(公告)日: | 2012-10-10 |
| 發明(設計)人: | 鄧恩華;李志雄 | 申請(專利權)人: | 深圳市江波龍電子有限公司 |
| 主分類號: | G06F15/16 | 分類號: | G06F15/16;G06F9/48 |
| 代理公司: | 深圳中一專利商標事務所 44237 | 代理人: | 張全文 |
| 地址: | 518000 廣東省深圳市南山區科發路8*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 處理器 設備 及其 程序 運行 方法 | ||
1.一種多處理器設備,包括主處理器和多個從處理器,所述主處理器與所述多個從處理器連接,其特征在于,所述多處理器設備還包括與所述多個從處理器相連接,用于存儲所述多個從處理器運行時所共用的程序代碼的代碼存儲器;以及
分別與所述多個從處理器一一對應連接的多個緩沖存儲器;所述多個緩沖存儲器中的每個緩沖存儲器用于通過與其對應連接的從處理器從所述代碼存儲器中調用并存儲所述從處理器于下一時刻所需要訪問的程序代碼。
2.如權利要求1所述的多處理器設備,其特征在于,所述代碼存儲器為RAM、ROM或閃存。
3.一種基于如權利要求1所述的多處理器設備的程序運行方法,所述程序運行方法包括以下步驟:
將多個從處理器共用的程序代碼加載至代碼存儲器;
多個緩沖存儲器從所述代碼存儲器中調用并存儲所述多個從處理器于下一時刻所需要訪問的程序代碼;
所述多個從處理器中的每個從處理器從與其對應連接的緩沖存儲器中讀取所述下一時刻所需要訪問的程序代碼并運行。
4.如權利要求3所述的程序運行方法,其特征在于,所述將多個從處理器共用的程序代碼加載至代碼存儲器的步驟具體為:
當所述代碼存儲器為RAM時,在所述多處理器設備每次上電啟動后,所述代碼存儲器從所述多處理器設備的程序存儲器中加載所述多個從處理器共用的程序代碼。
5.如權利要求3所述的程序運行方法,其特征在于,所述將多個從處理器共用的程序代碼加載至代碼存儲器的步驟還具體為:
當所述代碼存儲器為ROM或閃存時,在所述多處理器設備上電啟動前,將所述多個從處理器共用的程序代碼預先加載至所述代碼存儲器。
6.如權利要求3所述的程序運行方法,其特征在于,所述多個緩沖存儲器從所述代碼存儲器中調用并存儲所述多個從處理器于下一時刻所需要訪問的程序代碼的步驟具體包括以下步驟:
所述多個緩沖存儲器中的每個緩沖存儲器向與其對應連接的從處理器發送調用請求;
所述從處理器根據所述調用請求向與其對應連接的緩沖存儲器發出程序代碼調用命令;
所述緩沖存儲器通過所述從處理器從所述代碼存儲器中調用并存儲所述從處理器于下一時刻所需要訪問的程序代碼。
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