[發明專利]時鐘切換電路和時鐘切換方法無效
| 申請號： | 201210142508.6 | 申請日： | 2012-05-04 |
| 公開（公告）號： | CN102778917A | 公開（公告）日： | 2012-11-14 |
| 發明（設計）人： | 小菅莊司 | 申請（專利權）人： | 索尼公司 |
| 主分類號： | G06F1/04 | 分類號： | G06F1/04;H03K5/125 |
| 代理公司： | 北京東方億思知識產權代理有限責任公司 11258 | 代理人： | 宋鶴 |
| 地址： | 日本*** | 國省代碼： | 日本;JP |
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| 摘要： | |||
| 搜索關鍵詞： | 時鐘 切換 電路 方法 | ||
1.一種時鐘切換電路，該時鐘切換電路將輸入到該時鐘切換電路的與第一時鐘同步的數據作為與第二時鐘同步的輸出數據輸出，該電路包括：
雙端口RAM，該雙端口RAM能夠相互獨立地執行寫入和讀??；
寫入地址控制部件，該寫入地址控制部件控制所述雙端口RAM的寫入地址，其中輸入數據被寫入所述寫入地址；
空白地址檢測部件，該空白地址檢測部件檢測所述寫入地址中的沒有被寫入輸入數據的空白地址；以及
讀取地址轉換部件，該讀取地址轉換部件將所述雙端口RAM的除所述空白地址以外的寫入地址轉換為讀取地址，其中輸出數據被從所述讀取地址讀出。
2.根據權利要求1所述的時鐘切換電路，還包括：
相位同步電路，該相位同步電路建立所述寫入地址的最高有效位的相位和所述讀取地址的最高有效位的相位之間的同步，其中
所述讀取地址轉換部件對與所述寫入地址的最高有效位的相位同步的所述讀取地址的最高有效位的相位進行反轉。
3.根據權利要求1所述的時鐘切換電路，其中，所述第一時鐘的頻率比所述第二時鐘的頻率高，并且其中所述第一時鐘的頻率與所述第二時鐘的頻率之比是由整數表示的比值。
4.根據權利要求3所述的時鐘切換電路，其中，所述讀取地址轉換部件基于表格來將所述寫入地址轉換為所述讀取地址，其中在該表格上所述空白地址和所述讀取地址被根據所述整數比值相關聯。
5.一種由時鐘切換電路執行的時鐘切換方法，其中該時鐘切換電路將輸入到該時鐘切換電路的與第一時鐘同步的數據作為與第二時鐘同步的輸出數據輸出，并且該時鐘切換電路包括能夠相互獨立地執行寫入和讀取的雙端口RAM，該方法包括：
控制所述雙端口RAM的寫入地址，其中輸入數據被寫入所述寫入地址；
檢測所述寫入地址中的沒有被寫入輸入數據的空白地址；以及
將所述雙端口RAM的除所述空白地址以外的寫入地址轉換為讀取地址，其中輸出數據被從所述讀取地址讀出。
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