[發明專利]半導體器件有效
| 申請號: | 201210132450.7 | 申請日: | 2012-04-27 |
| 公開(公告)號: | CN103023477A | 公開(公告)日: | 2013-04-03 |
| 發明(設計)人: | 金美慧 | 申請(專利權)人: | 海力士半導體有限公司 |
| 主分類號: | H03K19/00 | 分類號: | H03K19/00 |
| 代理公司: | 北京弘權知識產權代理事務所(普通合伙) 11363 | 代理人: | 俞波;郭放 |
| 地址: | 韓國*** | 國省代碼: | 韓國;KR |
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| 摘要: | |||
| 搜索關鍵詞: | 半導體器件 | ||
相關申請的交叉引用
本申請要求2011年9月27日提交的韓國專利申請No.10-2011-0097531的優先權,其全部內容通過引用合并于此。
技術領域
本發明的示例性實施例涉及一種半導體設計技術,且更具體而言涉及一種包括支持預加重(pre-emphasis)操作的數據輸出電路的半導體器件。
背景技術
圖1是說明現有的數據輸出電路的框圖。
參看圖1,現有的數據輸出電路包括上拉前置主驅動器110、上拉主驅動器120、下拉前置主驅動器130和下拉主驅動器140。
上拉前置主驅動器110和下拉前置主驅動器130將輸出數據OUT_DATA反相并驅動并且輸出上拉驅動數據PU_PMDATA和下拉驅動數據PD_PMDATA。
上拉主驅動器120在上拉驅動數據PU_PMDATA處于邏輯低電平的時段中用外部電源電壓VDD來驅動數據輸出焊盤DQ。
下拉主驅動器140在下拉驅動數據PD_PMDATA處于邏輯高電平的時段中用外部接地電壓VSS來驅動數據輸出焊盤DQ。
如上文所述,由于現有的數據輸出電路根據被施加的輸出數據OUT_DATA的邏輯電平而用外部電源電壓VDD或外部接地電壓VSS來對數據輸出焊盤DQ執行驅動操作,因此數據輸出焊盤DQ的實際電壓電平可能會顯著地變化。
發明內容
本發明的實施例涉及一種包括支持預加重操作的數據輸出電路的半導體器件,所述預加重操作可以響應于工藝、電壓和溫度(PVT)的變化來改變操作驅動力。
根據本發明的一個實施例,一種半導體器件包括:碼發生器,所述碼發生器被配置成產生具有響應于阻抗碼的變化而變化的值的補充碼;主驅動器,所述主驅動器被配置成接收輸出數據且將所接收的輸出數據驅動至數據輸出焊盤,其中所述主驅動器的驅動力根據所述阻抗碼而受控制;以及輔助驅動器,所述輔助驅動器被配置成接收所述輸出數據且將所接收的輸出數據驅動至數據輸出焊盤,其中所述輔助驅動器的驅動力根據所述補充碼而受控制。
根據本發明的另一個實施例,一種半導體器件包括:碼發生器,所述碼發生器被配置成產生上拉補充碼和下拉補充碼,其中所述上拉補充碼和所述下拉補充碼分別響應于上拉阻抗碼的變化和下拉阻抗碼的變化而變化;上拉驅動器,所述上拉驅動器被配置成接收輸出數據且通過使用多個主上拉驅動器和多個輔助上拉驅動器來對數據輸出焊盤上拉驅動;以及下拉驅動器,所述下拉驅動器被配置成接收所述輸出數據且通過使用多個主下拉驅動器和多個輔助下拉驅動器來對所述數據輸出焊盤下拉驅動,其中所述主上拉驅動器響應于所述上拉阻抗碼而被控制為接通/斷開,所述輔助上拉驅動器響應于所述上拉補充碼而被控制為接通/斷開,所述主下拉驅動器響應于所述下拉阻抗碼而被控制為接通/斷開,且所述輔助下拉驅動器響應于所述下拉補充碼而被控制為接通/斷開。
附圖說明
圖1是說明支持預加重操作的現有的數據輸出電路的框圖。
圖2是說明根據本發明的第一實施例的支持預加重操作的數據輸出電路的框圖。
圖3是說明根據本發明的第二實施例的支持預加重操作的數據輸出電路的框圖。
圖4A和圖4B是詳細說明根據本發明的第二實施例的在圖3所示的支持預加重操作的數據輸出電路的組成部件之中的碼發生器的電路圖。
圖5A和圖5B是詳細說明根據本發明的第二實施例的在圖3所示的支持預加重操作的數據輸出電路的組成部件之中的多個輔助驅動器的電路圖。
圖6A和圖6B是描述根據本發明的第二實施例的在圖3所示的支持預加重操作的數據輸出電路的組成部件之中的碼發生器的操作的曲線圖和表格。
圖7A和圖7B是說明根據本發明的第二實施例的在圖3所示的支持預加重操作的數據輸出電路的組成部件之中的上拉驅動控制信號發生器和下拉驅動控制信號發生器的電路圖。
圖8A至圖8D是描述根據本發明的第二實施例的圖3所示的支持預加重操作的數據輸出電路的操作的時序圖。
具體實施方式
下文將參考附圖更詳細地描述本發明的示例性實施例。然而,本發明可以用不同的方式實施且不應解釋為局限于本文中所述的實施例。確切地說,提供這些實施例是為了使本說明書清楚且完整,且向本領域技術人員完全傳達本發明的范圍。在本說明書中,相同的附圖標記在本說明書的各個附圖和實施例中表示相同的部件。
<第一實施例>
圖2是說明根據本發明的第一實施例的支持預加重操作的數據輸出電路的框圖。
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