[發明專利]一種基于SOI襯底的高遷移率雙溝道材料的制備方法無效
| 申請號: | 201110151806.7 | 申請日: | 2011-06-08 |
| 公開(公告)號: | CN102820253A | 公開(公告)日: | 2012-12-12 |
| 發明(設計)人: | 張苗;張波;薛忠營;王曦 | 申請(專利權)人: | 中國科學院上海微系統與信息技術研究所;上海新傲科技股份有限公司 |
| 主分類號: | H01L21/762 | 分類號: | H01L21/762;H01L21/8238 |
| 代理公司: | 上海光華專利事務所 31219 | 代理人: | 李儀萍 |
| 地址: | 200050 *** | 國省代碼: | 上海;31 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 基于 soi 襯底 遷移率 溝道 材料 制備 方法 | ||
1.一種基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于,包括以下步驟:
步驟一、在SOI襯底上外延生長SiGe層,其中SOI襯底由下至上依次由硅襯底、絕緣埋層和頂層硅組成;
步驟二、在所述SiGe層上繼續外延生長Si蓋帽層;
步驟三、在所述Si蓋帽層上形成光刻膠,利用光刻刻蝕工藝將部分Si蓋帽層露出;
步驟四、在露出的Si蓋帽層上繼續外延生長Si層;
步驟五、進行離子注入,使注入的離子分布在SOI襯底的頂層硅中;
步驟六、進行退火工藝,使部分SiGe層中的應力產生弛豫,從而將應力轉移到其上方外延的Si材料中形成應變硅;形成的應變硅用于形成NMOSFET溝道,在光刻膠覆蓋區域下方的SiGe層用于形成PMOSFET溝道。
2.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟一所采用的SOI襯底的頂層硅厚度為5-100nm,絕緣埋層厚度為10-500nm。
3.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟一在SOI襯底上外延生長SiGe層之前,還需要對該SOI襯底進行RCA清洗。
4.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟一外延生長的SiGe層中,Ge含量為10%-50%。
5.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟一外延生長的SiGe層的厚度為5-200nm。
6.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟二外延生長的Si蓋帽層的厚度為2-5nm。
7.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟四外延生長的Si層的厚度為5-20nm。
8.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟五注入的離子為H、He、N、Si、C中的一種或多種。
9.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟五離子注入的劑量為1E13-1E18/cm2。
10.根據權利要求1所述的基于SOI襯底的高遷移率雙溝道材料的制備方法,其特征在于:步驟五退火的溫度為300-1000℃,時間為1分鐘至2小時。
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H01L 半導體器件;其他類目中不包括的電固體器件
H01L21-00 專門適用于制造或處理半導體或固體器件或其部件的方法或設備
H01L21-02 .半導體器件或其部件的制造或處理
H01L21-64 .非專門適用于包含在H01L 31/00至H01L 51/00各組的單個器件所使用的除半導體器件之外的固體器件或其部件的制造或處理
H01L21-66 .在制造或處理過程中的測試或測量
H01L21-67 .專門適用于在制造或處理過程中處理半導體或電固體器件的裝置;專門適合于在半導體或電固體器件或部件的制造或處理過程中處理晶片的裝置
H01L21-70 .由在一共用基片內或其上形成的多個固態組件或集成電路組成的器件或其部件的制造或處理;集成電路器件或其特殊部件的制造





