[實(shí)用新型]利用低倍率取樣時鐘實(shí)現(xiàn)數(shù)字時鐘恢復(fù)的電路無效
| 申請?zhí)枺?/td> | 201020568008.5 | 申請日： | 2010-10-20 |
| 公開（公告）號： | CN201839296U | 公開（公告）日： | 2011-05-18 |
| 發(fā)明（設(shè)計）人： | 蘇紅;謝建庭;常濤;王克;宋光偉;李柬;孫光;苗堯飛;李艷軍;李續(xù) | 申請（專利權(quán)）人： | 天津光電通信技術(shù)有限公司 |
| 主分類號： | H04L7/00 | 分類號： | H04L7/00 |
| 代理公司： | 天津中環(huán)專利商標(biāo)代理有限公司 12105 | 代理人： | 胡京生 |
| 地址： | 300211*** | 國省代碼： | 天津;12 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 利用 倍率 取樣 時鐘 實(shí)現(xiàn) 數(shù)字 恢復(fù) 電路 | ||
【權(quán)利要求書】：
1.一種利用低倍率取樣時鐘實(shí)現(xiàn)數(shù)字時鐘恢復(fù)的電路，其特征在于：包括FPGA芯片，所述FPGA芯片內(nèi)部電路的連接關(guān)系為：DLL級聯(lián)倍頻電路的輸出，一路與分頻器連接，另一路進(jìn)入邊沿檢測電路供其使用，檢測結(jié)果對分頻器復(fù)位。
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