[實用新型]一種偽隨機碼序列發生器無效
| 申請號： | 200920214497.1 | 申請日： | 2009-11-30 |
| 公開（公告）號： | CN201654762U | 公開（公告）日： | 2010-11-24 |
| 發明（設計）人： | 馮筱林 | 申請（專利權）人： | 上海第二工業大學 |
| 主分類號： | G06F7/58 | 分類號： | G06F7/58 |
| 代理公司： | 上海信好專利代理事務所(普通合伙) 31249 | 代理人： | 徐茂泰 |
| 地址： | 201209 上*** | 國省代碼： | 上海;31 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 隨機 序列 發生器 | ||
【權利要求書】：
1.一種偽隨機碼序列發生器，其特征在于，包含M序列發生模塊(10)、異或模塊(20)；所述M序列發生模塊(10)的輸出引腳與異或模塊(20)的輸入引腳連接；所述異或模塊(20)的輸出引腳與M序列發生模塊(10)的輸入引腳連接。
2.如權利要求1所述的偽隨機碼序列發生器，其特征在于，所述M序列發生模塊(10)包含多個依次連接的移位寄存模塊(11)；所述移位寄存模塊(11)設有時鐘信號引腳clk、初始輸入引腳X、數據輸入引腳Y、數據輸出引腳Q。
3.如權利要求2所述的偽隨機碼序列發生器，其特征在于，所述多個移位寄存模塊(11)的每一級移位寄存模塊(11)的數據輸出引腳Q與相鄰一級移位寄存模塊(11)的數據輸入引腳Y連接。
4.如權利要求2所述的偽隨機碼序列發生器，其特征在于，所述異或模塊(20)設有第一輸入引腳C1、第二輸入引腳C2；所述第一輸入引腳C1、第二輸入引腳C2分別與依次連接的多個移位寄存模塊(11)其中的任意兩個移位寄存模塊(11)的數據輸出引腳Q連接。
5.如權利要求1所述的偽隨機碼序列發生器，其特征在于，還包含時鐘信號模塊(40)；所述時鐘信號模塊(40)分別與M序列發生模塊(10)連接。
6.如權利要求1所述的偽隨機碼序列發生器，其特征在于，還包含初始輸入模塊(30)；所述初始輸入模塊(30)與M序列發生模塊(10)連接。?
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