[實用新型]全硬件時間同步裝置有效
| 申請號： | 200920085598.3 | 申請日： | 2009-05-11 |
| 公開（公告）號： | CN201616004U | 公開（公告）日： | 2010-10-27 |
| 發明（設計）人： | 周海斌;董旭東;付毅 | 申請（專利權）人： | 武漢國電武儀電力自動化設備有限公司 |
| 主分類號： | G04G7/02 | 分類號： | G04G7/02;G06F1/12;H04L29/02;H04L7/00 |
| 代理公司： | 暫無信息 | 代理人： | 暫無信息 |
| 地址： | 430074 湖北省武漢市*** | 國省代碼： | 湖北;42 |
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| 摘要： | |||
| 搜索關鍵詞： | 硬件 時間 同步 裝置 | ||
1.全硬件時間同步裝置，其特征是：它包括母板、電源插件、光纖插件、主時鐘插件、守時插件和至少一個擴展輸出插件；各插件與母板相連，通過母板進行信號傳遞和電源供給。
2.根據權利要求1所述的全硬件時間同步裝置，其特征是：所述主時鐘插件包括，衛星接收模塊(4)、UTC信號解碼器(5)、IRIG-B碼解碼器(6)、輸出信號編碼器(7)和監控模塊(8)；其中，
衛星接收模塊(4)和UTC信號解碼器(5)相連，將接收的衛星信號轉換為UTC信號發送給UCT信號解碼器(5)；
UTC信號解碼器(5)和監控模塊(8)、輸出編碼器(7)相連，將接收的UTC信號解碼成時間信息后發送給輸出編碼器(7)；
IRIG-B碼解碼器(6)和監控模塊(8)、輸出編碼器(7)相連，將光纖插件接收的IRIG-B碼信號解碼成時間信號后發送給輸出編碼器(7)；
監控模塊(8)監視解碼器發送時間信息的有效性，根據預先設定的優先級選擇當前使用的時鐘源；
輸出信號編碼器(7)將接收的時間信號編碼后，輸出脈沖、IRIG-B碼、串口信號、DCF77信號到各擴展插件。
3.根據權利要求1所述的全硬件時間同步裝置，其特征是：所述主時鐘插件采用一片FPGA芯片將UTC信號解碼器(5)、IRIG-B碼解碼器(6)、輸出信號編碼器(7)和監控模塊(8)集成于芯片內部；各功能模塊之間通信以芯片內部連線連接。
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