[實(shí)用新型]基于可編程邏輯器件的NAND閃存啟動(dòng)裝置無(wú)效
| 申請(qǐng)?zhí)枺?/td> | 200820093441.0 | 申請(qǐng)日： | 2008-04-16 |
| 公開(kāi)（公告）號(hào)： | CN201185088Y | 公開(kāi)（公告）日： | 2009-01-21 |
| 發(fā)明（設(shè)計(jì)）人： | 吳江東;范世杰;游江;魯禮元 | 申請(qǐng)（專利權(quán)）人： | 浩通科技(深圳)有限公司 |
| 主分類號(hào)： | G11C7/10 | 分類號(hào)： | G11C7/10 |
| 代理公司： | 深圳市順天達(dá)專利商標(biāo)代理有限公司 | 代理人： | 郭偉剛 |
| 地址： | 518067廣東省深圳市南山*** | 國(guó)省代碼： | 廣東;44 |
| 權(quán)利要求書(shū)： | 查看更多 | 說(shuō)明書(shū)： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 基于 可編程 邏輯 器件 nand 閃存 啟動(dòng) 裝置 | ||
1、一種基于可編程邏輯器件的NAND閃存啟動(dòng)裝置，包括NAND閃存(3)，其特征在于，還包括與所述NAND閃存(3)連接的NAND閃存控制器(2)，用于將NAND閃存(3)的NAND接口轉(zhuǎn)換為SRAM接口。
2、根據(jù)權(quán)利要求1所述的NAND閃存啟動(dòng)裝置，其特征在于，所述NAND閃存控制器(2)包括用于根據(jù)輸入的SRAM控制信號(hào)SR_CTRL產(chǎn)生NAND控制信號(hào)NA_CTRL的指令發(fā)生單元(8)以及與所述指令發(fā)生單元(8)連接的：
用于將SRAM數(shù)據(jù)總線SR_DATA緩存并送到NAND數(shù)據(jù)總線NA_IO的數(shù)據(jù)緩存單元(4)；
用于將SRAM地址總線SR_ADDR譯碼并復(fù)用到NAND數(shù)據(jù)總線NA_IO的地址譯碼單元(5)；
用于通過(guò)輸入忙閑指示信號(hào)NA_BUSY產(chǎn)生總線等待SR_WAIT控制信號(hào)的忙閑指示單元(6)；及
用于在系統(tǒng)啟動(dòng)時(shí)尋找第一個(gè)功能完好的啟動(dòng)代碼塊的壞塊探測(cè)單元(7)。
3、根據(jù)權(quán)利要求2所述的NAND閃存啟動(dòng)裝置，其特征在于，所述NAND閃存控制器(2)為可編程邏輯器件CPLD或FPGA。
4、根據(jù)權(quán)利要求2所述的NAND閃存啟動(dòng)裝置，其特征在于，所述SRAM控制信號(hào)SR_CTRL表示一組信號(hào)，包括片選信號(hào)SR_CS、讀使能信號(hào)SR_RD、寫(xiě)使能信號(hào)SR_WR和地址鎖存信號(hào)SR_ALE。
5、根據(jù)權(quán)利要求2所述的NAND閃存啟動(dòng)裝置，其特征在于，所述NAND控制信號(hào)NA_CTRL表示一組信號(hào)，包括片選信號(hào)NA_CS、命令鎖存信號(hào)NA_CLE、地址鎖存信號(hào)NA_ALE、讀使能信號(hào)NA_RD和寫(xiě)使能信號(hào)NA_WR。
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