[發明專利]半導體存儲裝置及搭載它的半導體集成電路無效
| 申請號： | 200680018787.8 | 申請日： | 2006-05-18 |
| 公開（公告）號： | CN101185141A | 公開（公告）日： | 2008-05-21 |
| 發明（設計）人： | 高橋英治;齊藤義行 | 申請（專利權）人： | 松下電器產業株式會社 |
| 主分類號： | G11C11/401 | 分類號： | G11C11/401;H01L27/108;H01L21/8242;H01L27/10 |
| 代理公司： | 中科專利商標代理有限責任公司 | 代理人： | 汪惠民 |
| 地址： | 日本*** | 國省代碼： | 日本;JP |
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| 摘要： | |||
| 搜索關鍵詞： | 半導體 存儲 裝置 搭載 集成電路 | ||
1.一種半導體存儲裝置，其特征在于：能夠將存儲單元的電容器與電源線連接，而且能夠斷開該連接。
2.如權利要求1所述的半導體存儲裝置，其特征在于，具有：
并列配置的多個位線；
在與所述位線相交的方向并列配置的多個字線；
受所述字線中的一個控制，并將所述電容器中的一個與所述位線中的一個連接的第1晶體管；
將所述電容器中的一個與所述電源線連接的第2晶體管；以及
控制所述第2晶體管的選擇信號線。
3.如權利要求2所述的半導體存儲裝置，其特征在于：規定數量的所述第2晶體管，受相同的所述選擇信號線控制。
4.如權利要求2所述的半導體存儲裝置，其特征在于：所述選擇信號線，與規定數量的所述字線一一對應地設置。
5.如權利要求2所述的半導體存儲裝置，其特征在于：與所述第2晶體管連接的所述電源線，隨著與規定數量的所述位線或所述字線連接的所述存儲單元組的不同而不同。
6.如權利要求1所述的半導體存儲裝置，其特征在于，具有：
并列配置的多個位線；
在與所述位線相交的方向并列配置的多個字線；
受所述字線中的一個控制，并將所述電容器中的一個與所述位線中的一個連接的第1晶體管；
將所述位線中的一個與所述電源線連接的第3晶體管；以及
控制第3晶體管的選擇信號線。
7.如權利要求6所述的半導體存儲裝置，其特征在于：規定數量的所述第3晶體管，受相同的所述選擇信號線控制。
8.如權利要求6所述的半導體存儲裝置，其特征在于：所述第3晶體管，將多個所述位線與相同的所述電源線連接。
9.一種半導體集成電路，其特征在于：具有能夠將存儲單元的電容器與電源線連接而且能夠斷開該連接的半導體存儲裝置，所述半導體集成電路相應所進行的處理，變更與所述電源線連接的所述電容器的數量。
10.如權利要求9所述的半導體集成電路，其特征在于，還具有：
執行規定的應用程序的邏輯電路部；和
存儲器控制部，該存儲器控制部按照來自所述邏輯電路部的命令，控制所述半導體存儲裝置，特別是相應所進行的處理變更與所述電源線連接的所述電容器的數量。
11.如權利要求10所述的半導體集成電路，其特征在于，所述半導體存儲裝置包含：
并列配置的多個位線；
在與所述位線相交的方向并列配置的多個字線；
受所述字線中的一個控制，并將所述電容器中的一個與所述位線中的一個連接的第1晶體管；
將所述電容器中的一個或所述位線中的一個與所述電源線連接的第2晶體管；以及
控制所述第2晶體管的選擇信號線。
12.如權利要求11所述的半導體集成電路，其特征在于：所述存儲器控制部，相應所進行的處理，控制所述選擇信號線。
13.如權利要求11所述的半導體集成電路，其特征在于：所述半導體存儲裝置，進而包含控制所述選擇信號線的寄存器；
所述存儲器控制部，按照處理，控制所述寄存器。
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