[其他]用低速器件合成565兆畢特/秒最長線性移位寄存器序列的電路在審
| 申請號: | 101985000006753 | 申請日: | 1985-09-10 |
| 公開(公告)號: | CN85106753B | 公開(公告)日: | 1988-06-29 |
| 發明(設計)人: | 李秉鈞 | 申請(專利權)人: | 郵電部第五研究所 |
| 主分類號: | 分類號: | ||
| 代理公司: | 北京德琦知識產權代理有限公司 | 代理人: | 李東;姚景蘭 |
| 地址: | 四川省成*** | 國省代碼: | 四川;51 |
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| 摘要: | |||
| 搜索關鍵詞: | 低速 器件 合成 565 兆畢特 最長 線性 移位寄存器 序列 電路 | ||
1、一種用低速器件合成565兆畢特/秒最長線性移位寄存器序列的電路,本發明的特征在于其電路是由三部分組成:速率為565MHZ/n的M序列發生器〔1〕,n可以取4或8;組合邏輯電路〔2〕,將〔1〕的一部分輸出接入〔2〕,用模二加方法組合成速率為565/n兆畢特/秒的n個輸出支路的M序列;并串變換電路〔3〕,將組合邏輯的n個輸出進行并行輸入串行輸出變換,得到一個速率為565兆畢特/秒的M序列輸出。
2、按照權利要求1所述的這種電路,其特征在于所說的并串變換電路可由輸出端具有線或功能的D觸發器來實現。
3、按照權利要求1所述的這種電路,其特征在于所說的并串變換電路可由八分頻加譯碼選通,門的輸出端具有線或功能來實現。
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