[其他]指令處理器在審
| 申請號： | 101985000002313 | 申請日： | 1985-04-01 |
| 公開（公告）號： | CN85102313B | 公開（公告）日： | 1988-05-04 |
| 發明（設計）人： | 栗山和則;和田健一;小岡彰 | 申請（專利權）人： | 株式會社日立制作所 |
| 主分類號： | 分類號： | ||
| 代理公司： | 中國專利代理有限公司 | 代理人： | 李先春 |
| 地址： | 日本東京都千*** | 國省代碼： | 暫無信息 |
| 權利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | 給要求兩個或者更多操數的指令的每個操作數，分別提供地址計算加法器和緩沖存貯器。在翻譯指令的處理中，地址計算和對第一個、第二個操作數的取操作，實質上是異步送行的。因而每幾個第二個操作數的每次取操作數所化的額外化費可以采用一組地址加法器獨立或同步完成地址計算和取數操作的方法來扣掉，而且，采用一個操作步驟能夠省掉用來從操作數緩沖四分離并得到一個字節的線路，在該操作步驟中，第一個操作數的一個字節取出并存入暫存存貯器中，這存貯器提供其中存貯的數據給地址加法器。 | ||
| 搜索關鍵詞： | 指令 處理器 | ||
【主權項】：
暫無信息
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