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[實用新型]一種分段式功率因數校正電路有效

專利信息
申請號: 202223016288.0 申請日: 2022-11-14
公開(公告)號: CN218733893U 公開(公告)日: 2023-03-24
發明(設計)人: 趙顯云 申請(專利權)人: 珠海市圣昌電子有限公司
主分類號: H02M1/42 分類號: H02M1/42;H02M7/04;H02M7/217;H02M3/156
代理公司: 中山市銘洋專利商標事務所(普通合伙) 44286 代理人: 孫思杰
地址: 519000 廣東省*** 國省代碼: 廣東;44
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摘要:
搜索關鍵詞: 一種 段式 功率因數 校正 電路
【權利要求書】:

1.一種分段式功率因數校正電路,其特征在于,包括:

輸入模塊(10),連接于市電;

比較模塊(20),與所述輸入模塊(10)連接;

功率因數校正模塊(30),與所述輸入模塊(10)以及比較模塊(20)連接,負載接入所述功率因數校正模塊(30);

所述比較模塊(20)接入基準電壓源Vref,用于比較經所述比較模塊(20)的降壓、濾波后的市電以及所述基準電壓源Vref,并反饋至所述功率因數校正模塊(30),所述功率因數校正模塊(30)可在降壓、濾波后的市電低于所述基準電壓源Vref時降低輸出電壓,或所述功率因數校正模塊(30)可在降壓、濾波后的市電高于所述基準電壓源Vref時提高輸出電壓。

2.根據權利要求1所述的一種分段式功率因數校正電路,其特征在于:所述輸入模塊(10)包括整流橋DB1以及濾波電容C1,整流橋DB1的輸入端分別接入市電的火線L和零線N,整流橋DB1的輸出端分別接入所述濾波電容C1的兩端以及與所述比較模塊(20)和功率因數校正模塊(30)連接。

3.根據權利要求1所述的一種分段式功率因數校正電路,其特征在于:所述比較模塊(20)包括電阻R1-4、電容C2、比較器U1以及MOS管Q2,電阻R1的一端分別與所述輸入模塊(10)以及功率因數校正模塊(30)連接,電阻R1的另一端分別與電容C2的一端、電阻R2的一端以及比較器U1的正相輸入端連接,比較器U1的電源端接入電源VCC,電容C2的另一端分別與電阻R2的另一端、基準電壓源Vref的一端、比較器U1的接地端、MOS管Q2的源極以及所述功率因數校正模塊(30)連接,基準電壓源Vref的另一端與比較器U1的反相輸入端連接,比較器U1的輸出端經電阻R3與MOS管Q2的柵極連接,MOS管Q2的漏極經電阻R4與所述功率因數校正模塊(30)連接。

4.根據權利要求3所述的一種分段式功率因數校正電路,其特征在于:所述功率因數校正模塊(30)包括主控芯片U2、電感L1、MOS管Q1、二極管D1、電阻R5-7以及電容C3,電感L1的一端與所述輸入模塊(10)連接,電感L1的另一端分別與二極管D1的陽極以及MOS管Q1的漏極連接,MOS管Q1的柵極與主控芯片U2的GATE引腳連接,MOS管Q1的源極與電阻R5的一端以及主控芯片U2的CS引腳連接,二極管D1的陰極分別與二極管D6的一端、電容C3的一端以及負載的一端連接,電阻R6的另一端分別與主控芯片U2的FB引腳、電阻R7的一端以及電阻R4的另一端連接,電阻R5的另一端分別與所述MOS管Q2的源極、電阻R7的另一端、電容C3的另一端、接地端以及負載的另一端連接。

5.根據權利要求1所述的一種分段式功率因數校正電路,其特征在于:所述比較模塊(20)包括電阻R1-4、電容C2、比較器U1以及MOS管Q2,電阻R1的一端分別與所述輸入模塊(10)以及功率因數校正模塊(30)連接,電阻R1的另一端分別與電容C2的一端、電阻R2的一端以及比較器U1的正相輸入端連接,比較器U1的電源端接入電源VCC,電容C2的另一端分別與電阻R2的另一端、基準電壓源Vref的一端、比較器U1的接地端、MOS管Q2的源極以及功率因數校正模塊(30)連接,基準電壓源Vref的另一端與比較器U1的反相輸入端連接,比較器U1的輸出端經電阻R3與MOS管Q2的柵極連接,MOS管Q2的漏極經電阻R4與所述功率因數校正模塊(30)連接。

6.根據權利要求5所述的一種分段式功率因數校正電路,其特征在于:所述功率因數校正模塊(30)包括主控芯片U2、電感L1、MOS管Q1、二極管D1、電阻R5-8以及電容C3,電感L1的一端與所述輸入模塊(10)連接,電感L1的另一端分別與二極管D1的陽極以及MOS管Q1的漏極連接,二極管D1的陰極分別與二極管D6的一端、電容C3的一端以及負載的一端連接,電阻R6的另一端分別與主控芯片U2的FB引腳、電阻R4的另一端以及電阻R7的一端連接,主控芯片U2的CS引腳經電阻R8分別與所述輸入模塊(10)以及電阻R5的一端連接,電阻R5的另一端分別與電阻R7的另一端、MOS管Q1的源極、MOS管Q2的源極、電容C3的另一端、接地端以及負載的另一端連接,MOS管Q1的柵極與主控芯片U2的GATE引腳連接。

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