[實用新型]一種限制并降低電流取樣電路壓降的取樣伺服電路有效
| 申請?zhí)枺?/td> | 202222095789.6 | 申請日： | 2022-08-10 |
| 公開（公告）號： | CN218272485U | 公開（公告）日： | 2023-01-10 |
| 發(fā)明（設(shè)計）人： | 王永強;楊志亮 | 申請（專利權(quán)）人： | 杭州導(dǎo)納電子有限公司 |
| 主分類號： | G01R19/00 | 分類號： | G01R19/00;G01R31/00 |
| 代理公司： | 杭州惟臻專利代理事務(wù)所(普通合伙) 33398 | 代理人： | 陳志鋒 |
| 地址： | 310000 浙江省杭*** | 國省代碼： | 浙江;33 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 限制 降低 電流 取樣 電路 伺服 | ||
1.一種限制并降低電流取樣電路壓降的取樣伺服電路，其特征在于，包括串聯(lián)在取樣電路上的第一取樣電阻Rs1與第二取樣電阻Rs2,所述第二取樣電阻Rs2的阻值遠(yuǎn)大于第一取樣電阻Rs1阻值，所述第二取樣電阻Rs2并聯(lián)有一N-MOS管Q1，所述取樣電阻Rs1用于被測電路Io輸入的一端連接N-MOS管Q1的D極，取樣電阻Rs1的另一端與N-MOS管Q1的S極連接，所述取樣電路還包括運算放大器A1、運算放大器A2、運算放大器A3、模數(shù)轉(zhuǎn)化器ADC1、模數(shù)轉(zhuǎn)化器ADC2以及中央處理器MCU，所述N-MOS管Q1的D極連接運算放大器A2的同相輸入端，所述N-MOS管Q1的S極連接運算放大器A2的反相輸入端，所述N-MOS管Q1的G極連接運算放大器A3的輸出端，所述運算放大器A2的輸出端分別連接運算放大器A3的同相輸入端以及模數(shù)轉(zhuǎn)化器ADC2的輸入端，所述運算放大器A3的反相輸入端連接設(shè)定電壓Vs，所述運算放大器A1的同相輸入端以及反相輸入端分別連接在第一取樣電阻Rs1的兩端，且運算放大器A1的反相輸入端接地，所述運算放大器A1的輸出端連接模數(shù)轉(zhuǎn)化器ADC1的輸入端，所述模數(shù)轉(zhuǎn)化器ADC1、模數(shù)轉(zhuǎn)化器ADC2的輸出端分別連接中央處理器MCU。
2.如權(quán)利要求1所述的限制并降低電流取樣電路壓降的取樣伺服電路，其特征在于，所述第二取樣電阻Rs2與一二極管D1并聯(lián)。
3.一種限制并降低電流取樣電路壓降的取樣伺服電路，其特征在于，包括串聯(lián)在取樣電路上的第一取樣電阻Rs1與第二取樣電阻Rs2,所述第二取樣電阻Rs2的阻值遠(yuǎn)大于第一取樣電阻Rs1阻值，所述第二取樣電阻Rs2并聯(lián)有一P-MOS管Q2，所述取樣電阻Rs1用于被測電路Io輸入的一端連接P-MOS管Q1的S極，取樣電阻Rs1的另一端與P-MOS管Q1的S極的D極連接，所述取樣電路還包括運算放大器A1、運算放大器A2、運算放大器A3、模數(shù)轉(zhuǎn)化器ADC1、模數(shù)轉(zhuǎn)化器ADC2以及中央處理器MCU，所述P-MOS管Q1的S極連接運算放大器A2的同相輸入端，所述P-MOS管Q1的D極連接運算放大器A2的反相輸入端，所述P-MOS管Q1的G極連接運算放大器A3的輸出端，所述運算放大器A2的輸出端分別連接運算放大器A3的反相輸入端以及模數(shù)轉(zhuǎn)化器ADC2的輸入端，所述運算放大器A3的同相輸入端連接設(shè)定電壓Vs，所述運算放大器A1的同相輸入端以及反相輸入端分別連接在第一取樣電阻Rs1的兩端，且運算放大器A1的反相輸入端接地，所述運算放大器A1的輸出端連接模數(shù)轉(zhuǎn)化器ADC1的輸入端，所述模數(shù)轉(zhuǎn)化器ADC1、模數(shù)轉(zhuǎn)化器ADC2的輸出端分別連接中央處理器MCU。
4.如權(quán)利要求3所述的限制并降低電流取樣電路壓降的取樣伺服電路，其特征在于，所述第二取樣電阻Rs2與一二極管D1并聯(lián)。
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