[發明專利]一種單板PCB走線仿真設計方法及裝置在審
| 申請號： | 202210150250.8 | 申請日： | 2022-02-18 |
| 公開（公告）號： | CN114528801A | 公開（公告）日： | 2022-05-24 |
| 發明（設計）人： | 李艷軍;秦清松;趙帥 | 申請（專利權）人： | 蘇州浪潮智能科技有限公司 |
| 主分類號： | G06F30/394 | 分類號： | G06F30/394;G06Q10/06;G06F115/12;G06F119/02 |
| 代理公司： | 北京三聚陽光知識產權代理有限公司 11250 | 代理人： | 項凱 |
| 地址： | 215000 江蘇省蘇州*** | 國省代碼： | 江蘇;32 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 單板 pcb 仿真 設計 方法 裝置 | ||
1.一種單板PCB走線仿真設計方法，其特征在于，包括：
建立走線單元模型，所述走線單元模型為單板PCB走線的最小線單元，所述走線單元模型包括以下走線變量：線寬、線長以及線間距；
根據預設步長對所述走線變量進行調節，以利用所述走線單元模型進行PCB走線的設置；
利用設置的PCB走線運行仿真，并對所述PCB走線進行評價指標掃描，得到包含單板PCB走線的評價指標的仿真結果。
2.根據權利要求1所述的單板PCB走線仿真設計方法，其特征在于，所述走線單元模型包括：單根線模型；所述單根線模型包括：兩段不同線寬并且相連的目標單根線和與所述目標單根線相間隔的對其產生串擾的第一信號線。
3.根據權利要求2所述的單板PCB走線仿真設計方法，其特征在于，所述第一信號線為至少兩段不同線寬并且相連的目標單根線，或者所述第一信號線為相同線寬的信號線。
4.根據權利要求2所述的單板PCB走線仿真設計方法，其特征在于，所述根據預設步長對所述走線變量進行調節，以利用所述走線單元模型進行PCB走線的設置，包括：
對于所述單根線模型，以第一段的線寬為目標線寬，第二段的線寬以第一預設步長增加或減少進行布線設置的調節；
以第二預設步長增加或減少所述目標單根線與所述第一信號線之間的間距。
5.根據權利要求1所述的單板PCB走線仿真設計方法，其特征在于，所述走線單元模型包括：差分線模型；所述差分線模型包括一對目標差分線，所述目標差分線包括：至少兩段不同線寬的傳輸線和與所述一對目標差分線相間隔的對其產生串擾的第二信號線。
6.根據權利要求5所述的單板PCB走線仿真設計方法，其特征在于，所述第二信號線與所述一對目標差分線具有相同結構，或者所述第二信號線為具有相同線寬和線距的信號線。
7.根據權利要求5所述的單板PCB走線仿真設計方法，其特征在于，所述根據預設步長對所述走線變量進行調節，以利用所述走線單元模型進行PCB走線的設置，包括：
對于所述差分線模型，以第一段的線寬作為目標線寬，第一段的差分線線距為目標差分線線距，以第三預設步長增加或減少線寬，并以第四預設步長減少差分線距；
以第五預設步長增加或減少所述差分線模型與所述第二信號線之間的間距。
8.一種單板PCB走線仿真設計裝置，其特征在于，包括：
建立模塊，用于建立走線單元模型，所述走線單元模型為單板PCB走線的最小線單元，所述走線單元模型包括以下走線變量：線寬、線長以及線間距；
調節模塊，用于根據預設步長對所述走線變量進行調節，以利用所述走線單元模型進行PCB走線的設置；
仿真模塊，用于利用設置的PCB走線運行仿真，得到包含單板PCB走線的評價指標的仿真結果。
9.一種計算機設備，其特征在于，包括：至少一個處理器；以及與所述至少一個處理器通信連接的存儲器；其中，所述存儲器存儲有可被所述至少一個處理器執行的指令，所述指令被所述至少一個處理器執行，從而執行如權利要求1-7中任一項所述的單板PCB走線仿真設計方法。
10.一種計算機可讀存儲介質，其特征在于，所述計算機可讀存儲介質存儲有計算機指令，所述計算機指令用于使計算機執行如權利要求1-7中任一項所述的單板PCB走線仿真設計方法。
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